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AD9876BSTRL

更新时间： 2024-02-09 15:40:49
品牌 Logo 应用领域
亚德诺 - ADI 调制解调器
页数 文件大小 规格书
24页 487K
描述
Broadband Modem Mixed-Signal Front End

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AD9876BSTRL 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：LQFP-48
针数：48Reach Compliance Code：unknown
ECCN代码：5A991.GHTS代码：8542.39.00.01
风险等级：5.84JESD-30 代码：S-PQFP-G48
JESD-609代码：e0长度：7 mm
功能数量：1端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装等效代码：QFP48,.35SQ,20封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3.3 V认证状态：Not Qualified
座面最大高度：1.6 mm子类别：Modems
最大压摆率：0.288 mA标称供电电压：3.3 V
表面贴装：YES技术：CMOS
电信集成电路类型：TELECOM CIRCUIT温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7 mm

AD9876BSTRL 数据手册

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(VS = 3.3 V ꢁ10%, fOSCIN = 32 MHz, fDAC = 128 MHz, Gain = –6 dB, RSET = 4.02 kꢂ,  
100 ꢂ DAC single-ended load, unless otherwise noted. )  
AD9876–SPECIFICATIONS  
Test  
Parameter  
Temp  
Level  
Min  
Typ  
Max  
Unit  
OSCIN CHARACTERISTICS  
Frequency Range  
Duty Cycle  
Input Capacitance  
Input Impedance  
Full  
Full  
25°C  
25°C  
II  
II  
III  
III  
10  
40  
64  
60  
MHz  
%
pF  
50  
3
100  
M⍀  
CLOCK OUTPUT CHARACTERISTICS  
CLK A Jitter (fCLKA Derived from PLL)  
CLK A Duty Cycle  
CLK B Jitter (fCLKB Derived from PLL)  
CLK B Duty Cycle  
25°C  
25°C  
25°C  
25°C  
III  
III  
III  
III  
14  
50  
33  
50  
ps rms  
%
ps rms  
%
5
5
Tx CHARACTERISTICS  
Tx Path Latency, 4× Interpolation  
Interpolation Filter Bandwidth (–0.1 dB)  
4× Interpolation, LPF  
Full  
II  
86  
fDAC Cycles  
Full  
Full  
II  
II  
13  
26  
MHz  
MHz  
2× Interpolation, LPF  
TxDAC  
Resolution  
Conversion Rate  
Full  
Full  
Full  
Full  
Full  
Full  
Full  
25°C  
25°C  
25°C  
II  
II  
II  
II  
II  
II  
III  
III  
III  
III  
12  
10  
Bits  
MHz  
mA  
V
% FS  
10  
2
–0.5  
–5  
0
128  
20  
+1.5  
+5  
5
Full-Scale Output Current  
Voltage Compliance Range  
Gain Error  
Output Offset (Single-Ended)  
Differential Nonlinearity  
Integral Nonlinearity  
Output Capacitance  
Phase Noise @ 1 kHz Offset, 10 MHz Signal  
Signal-to-Noise and Distortion (SINAD)  
2
2
1
µA  
LSB  
LSB  
pF  
2
5
–100  
dBc/Hz  
10 MHz Analog Out AD9876 (20 MHz BW) Full  
I
62.5  
65  
dB  
Wideband SFDR (to Nyquist, 64 MHz Max)  
5 MHz Analog Out  
10 MHz Analog Out  
Narrow-Band SFDR (3 MHz Window):  
10 MHz Analog Out  
IMD (f1 = 6.9 MHz, f2 = 7.1 MHz)  
25°C  
25°C  
25°C  
III  
III  
III  
80  
74  
dBc  
dBc  
25°C  
25°C  
III  
III  
88  
–80  
dBc  
dBFS  
Rx PATH CHARACTERISTICS  
Resolution  
Conversion Rate  
NA  
Full  
NA  
NA  
II  
NA  
12  
Bits  
MHz  
Cycles  
7.5  
64  
Pipeline Delay, ADC Clock Cycles  
5.5  
DC Accuracy  
Differential Nonlinearity  
Integral Nonlinearity  
Full  
Full  
II  
II  
–1.0  
–4.5  
0.25  
0.5  
+1.0  
+3.5  
LSB  
LSB  
Dynamic Performance (ADC Clocked Direct)  
(AIN = –0.5 dBFS, f = 5 MHz)  
@ fOSCIN = 32 MHz  
Signal-to-Noise and Distortion Ratio (SINAD)  
Effective Number of Bits (ENOB)  
Signal-to-Noise Ratio (SNR)  
Total Harmonic Distortion (THD)  
Spurious-Free Dynamic Range (SFDR)  
Dynamic Performance (ADC Clocked, PLLB/2)  
Full  
Full  
25°C  
25°C  
25°C  
I
I
III  
III  
III  
60.8  
9.8  
63.2  
10.2  
64  
–70  
72  
dB  
Bits  
dB  
dB  
dB  
(AIN = –0.5 dBFS, f = 5 MHz  
)
@ FPLLB/2 = 50 MHz  
Signal-to-Noise and Distortion Ratio (SINAD)  
Effective Number of Bits (ENOB)  
Signal-to-Noise Ratio (SNR)  
Total Harmonic Distortion (THD)  
Spurious-Free Dynamic Range (SFDR)  
25°C  
25°C  
25°C  
25°C  
25°C  
III  
III  
III  
III  
III  
56  
9.3  
59  
–63  
68  
dB  
Bits  
dB  
dB  
dB  
–2–  
REV. A  
1234567...24

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