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AD9851BRSZRL

更新时间: 2024-01-01 11:42:28
品牌 Logo 应用领域
亚德诺 - ADI 模拟IC信号电路光电二极管数据分配系统
页数 文件大小 规格书
24页 719K
描述
CMOS 180 MHz DDS/DAC Synthesizer

AD9851BRSZRL 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Active零件包装代码:SSOP
包装说明:SSOP,针数:28
Reach Compliance Code:unknown风险等级:5.05
Is Samacsys:N模拟集成电路 - 其他类型:ANALOG CIRCUIT
JESD-30 代码:R-PDSO-G28JESD-609代码:e3
长度:10.2 mm湿度敏感等级:1
功能数量:1端子数量:28
最高工作温度:85 °C最低工作温度:-40 °C
封装主体材料:PLASTIC/EPOXY封装代码:SSOP
封装形状:RECTANGULAR封装形式:SMALL OUTLINE, SHRINK PITCH
峰值回流温度(摄氏度):260座面最大高度:2 mm
最大供电电压 (Vsup):5.25 V最小供电电压 (Vsup):4.75 V
标称供电电压 (Vsup):5 V表面贴装:YES
技术:CMOS温度等级:INDUSTRIAL
端子面层:MATTE TIN端子形式:GULL WING
端子节距:0.65 mm端子位置:DUAL
处于峰值回流温度下的最长时间:40宽度:5.3 mm
Base Number Matches:1

AD9851BRSZRL 数据手册

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J1  
C36CPRX  
U2  
74HCT574  
1
2
3
4
5
6
7
8
AD9851/FSPCB  
FREQUENCY  
RRSET  
9
8
7
6
5
4
3
2
12  
13  
14  
15  
16  
17  
18  
19  
8D  
7D  
6D  
5D  
4D  
3D  
2D  
1D  
8Q  
D0  
D1  
D2  
D3  
D4  
D5  
D6  
D7  
SYNTHESIZER  
7Q  
6Q  
5Q  
4Q  
3Q  
2Q  
1Q  
EVALUATION BOARD  
J2  
J3  
J4  
+V  
D3  
D2  
D1  
D0  
1
2
3
4
5
6
7
8
9
D3  
D2  
D1  
D0  
D4 28 D4  
27  
BANANA  
JACKS  
D5  
D5  
+5V  
GND  
U1  
AD9851  
D6 26 D6  
D7 25 D7  
9
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
29  
30  
31  
32  
33  
34  
35  
36  
CK  
OE  
PGND  
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
GND  
+V  
DGND  
DVDD  
RESET  
IOUT  
GND  
+V  
11  
1
PVCC  
STROBE  
W CLK  
FQ UD  
REFCLOCK  
WCLK  
FQUD  
CLKIN  
GND  
RESET  
J6  
FFQUD  
DAC OUT  
TO 50  
R4  
IOUTB  
AGND  
AVDD  
DACBP  
VINP  
50  
R5  
25  
10 AGND  
GND  
+V  
R1  
AVDD  
+V 11  
3.9k  
10mA  
RESET  
R
12  
13  
NC  
SET  
U3  
74HCT574  
VOUTN  
TP5  
TP6  
TP7  
TP8  
TP1  
TP2  
TP3  
TP4  
14 VOUTP  
VINN  
9
8
7
6
5
4
3
2
12  
13  
14  
15  
16  
17  
18  
19  
COMPARATOR  
INPUTS  
8D  
7D  
6D  
5D  
4D  
3D  
2D  
1D  
8Q  
RRESET  
WWCLK  
FFQUD  
RESET  
WCLK  
FQUD  
GND  
GND  
GND  
GND  
7Q  
6Q  
5Q  
4Q  
3Q  
2Q  
1Q  
NC = NO CONNECT  
J5  
RRESET  
CHECK  
R5  
1k  
CLKIN  
+V  
R2  
50  
R7  
REMOVE WHEN  
USING Y1  
1k  
WWCLK  
CHECK  
GND  
CK  
5V  
14  
OE  
11  
1
V
CC  
STROBE  
XTAL  
OSC  
STROBE  
8
OUT  
Y1  
(OPTIONAL)  
GND  
7
+V  
5V  
+V  
5V  
C2  
0.1F  
C3  
0.1F  
C4  
0.1F  
C5  
0.1F  
C8  
0.1F  
C9  
0.1F  
C10  
0.1F  
C6  
10F  
C7  
10F  
MOUNTING HOLES  
5V  
H1  
#6  
H2  
#6  
H3  
#6  
H4  
#6  
R8  
2.2k  
R9  
2.2k  
R10  
2.2k  
R3  
2.2k  
STROBE  
WWCLK  
FFQUD  
RRESET  
Figure 22. FSPCB Electrical Schematic  
REV. D  
–19–  

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