Datasheet > 驱动程序和接口 > 其他接口集成电路> AD8387-EB

AD8387-EB

更新时间： 2024-01-03 21:55:38

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亚德诺 - ADI		/
页数	文件大小	规格书
16页	398K
描述
High Performance, 12-Bit, 12-Channel Decimating, LCD DecDriver

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AD8387-EB 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFP
包装说明：	HTFQFP,	针数：	80
Reach Compliance Code：	unknown	风险等级：	5.68
Is Samacsys：	N	接口集成电路类型：	INTERFACE CIRCUIT
JESD-30 代码：	S-PQFP-G80	JESD-609代码：	e3
长度：	12 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	80
最高工作温度：	85 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	HTFQFP
封装形状：	SQUARE	封装形式：	FLATPACK, HEAT SINK/SLUG, THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：	260	认证状态：	COMMERCIAL
座面最大高度：	1.2 mm	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	BIPOLAR
温度等级：	OTHER	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	40
宽度：	12 mm	Base Number Matches：	1

AD8387-EB 数据手册

AD8387

Table 3. 80-Lead TQFP E-Pad Pin Configurations

Pin No.

Mnemonic

Function

Description

1 to 7,

DBA(0:11)

Data Input

12-Bit Data Input for Even Channels. VID(0, 2, 4, 6, 8, 10), MSB = DBA11.

76 to 80;

14 to 25

DBB(0:11)

XFR

Data Input

12-Bit Data Input for Odd Channels. VID(1, 3, 5, 7, 9, 11), MSB = DBB11.

Transfer/Start Sequence

Simultaneously initiates a new data loading sequence and transfers data

loaded previously, to the outputs.

9, 26, 75

10, 27, 74

DVCCx

DGNDx

CLK

DSW

R/L

ISW

INV

GSW

TSW

AGNDx

Digital Power Supplies

Digital Ground

Clock

Data Mode Switch

Right/Left Select

Invert Mode Switch

Invert

Output Mode Switch

Thermal Switch

Analog Ground

Digital Power Supplies.

These pins are normally connected to the digital ground plane.

Clock Input.

Selects Single Buss or Dual Buss Operating Modes.

Selects Left Direction or Right Direction Operating Mode.

Enables and Disables Column Inversion.

Changes the Polarity of the Analog Output Signals.

Enables and Disables Grounded Mode.

Enables and Disables Long-Term Output Protection.

Analog Supply Returns.

32, 33, 39, 43,

47, 51, 55, 59,

63, 69, 70

34, 35, 41,

45, 49, 53,

57, 61, 67, 68

AVCCx

BYP

Analog Power Supplies

Bypass

Analog Power Supplies.

A 0.1 μF capacitor connected between BYP and AGND ensures optimum

settling time.

TSTA

Test Pin

Connect This Pin to AGND.

38, 71 to 73

No Connect. No internal connection.

40, 42, 44, 46,

48, 50, 52, 54,

56, 58, 60, 62

VID0 to VID11

Analog Outputs

These pins are connected directly to the analog inputs of the LCD panel.

VRL

Video Center Reference

Full-Scale Reference

This Voltage Sets the Video Center Voltage. The video outputs are above

this reference while INV = HIGH and below this reference while INV = LOW.

Twice the voltage applied between VRH and VRL sets the full-scale

video output voltage.

65, 66

VRH

Rev. 0 | Page 7 of 16

1...4 5 678 9 10...16

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型号	品牌	描述	获取价格	数据表
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