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AD7794

更新时间： 2024-02-28 13:09:34
品牌 Logo 应用领域
亚德诺 - ADI 仪表放大器
页数 文件大小 规格书
21页 261K
描述
Low Power, 24-Bit Sigma-Delta ADC with In-Amp and Embedded Reference (6 Channel)

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AD7794 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSSOP
包装说明：TSSOP, TSSOP24,.25针数：24
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.38
转换器类型：ADC, DELTA-SIGMAJESD-30 代码：R-PDSO-G24
JESD-609代码：e3长度：7.8 mm
最大线性误差 (EL)：0.0015%湿度敏感等级：1
模拟输入通道数量：6位数：24
功能数量：1端子数量：24
最高工作温度：125 °C最低工作温度：-40 °C
输出位码：OFFSET BINARY输出格式：SERIAL
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP24,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：3/5 V认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Analog to Digital Converters
标称供电电压：3 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：4.4 mm
Base Number Matches：1

AD7794 数据手册

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Preliminary Technical Data  
AD7794—SPECIFICATIONS1  
AD7794  
Table 1. (AVDD = 2.7 V to 5.25 V; DVDD = 2.7 V to 5.25 V; GND = 0 V; all specifications TMIN to TMAX, unless otherwise noted.)  
Parameter  
AD7794B  
Unit  
Test Conditions/Comments  
AD7794 (CHOP ENABLED)  
Output Update Rate  
4
Hz min nom  
Hz max nom  
Bits min  
Bits p-p  
Bits p-p  
Settling Time = 2/Output Update Rate  
500  
24  
16  
19  
No Missing Codes2  
Resolution (pk – pk)  
fADC ≤125 Hz  
Gain = 128, 16.6 Hz Update Rate, VREF = 2.5 V  
Gain = 1, 16.6 Hz Update Rate, VREF = 2.5 V  
Output Noise and Update Rates  
Integral Nonlinearity  
See Tables in ADC  
Description  
15  
25  
3
ppm of FSR max 3.5 ppm typ. Gain = 1 to 32  
ppm of FSR max 5 ppm typ, Gain = 64 or 128  
µV typ  
Offset Error3  
Offset Error Drift vs. Temperature4  
Full-Scale Error3, 5  
10  
10  
0.5  
3
nV/°C typ  
µV typ  
ppm/°C typ  
ppm/°C typ  
dB min  
Gain Drift vs. Temperature4  
Gain = 1 or 2  
Gain = 4 to 128  
100 dB typ, AIN = FS/2  
Power Supply Rejection  
ANALOG INPUTS  
90  
Differential Input Voltage Ranges  
REFIN/Gain  
V nom  
REFIN = REFIN(+) – REFIN(–) or Internal Reference,  
Gain = 1 to 128  
Absolute AIN Voltage Limits2  
Unbuffered Mode  
GND – 30 mV  
AVDD + 30 mV  
GND + 100 mV  
AVDD – 100 mV  
GND + 300 mV  
AVDD – 1.1  
V min  
V max  
V min  
V max  
V min  
V max  
V min  
Gain = 1 or 2  
Gain = 1 or 2  
Gain = 4 to 128  
Gain = 4 to 128  
Buffered Mode  
In-Amp Enabled  
Common Mode Voltage  
Analog Input Current  
0.5  
Buffered Mode or In-Amp Enabled  
Average Input Current2  
Average Input Current Drift  
Unbuffered Mode  
200  
2
pA max  
pA/°C typ  
Gain = 1 or 2  
Average Input Current  
Average Input Current Drift  
400  
50  
nA/V typ  
pA/V/°C typ  
nA max  
Input current varies with input voltage.  
1
AIN6(+) / AIN6(-)  
Normal Mode Rejection2  
Internal Clock  
@ 50 Hz, 60 Hz  
@ 50 Hz  
70  
84  
90  
dB min  
dB min  
dB min  
80 dB typ, 50 1 Hz, 60 1 Hz, FS[3:0] = 10106  
90 dB typ, 50 1 Hz, FS[3:0] = 10016  
100 dB typ, 60 1 Hz, FS[3:0] = 10006  
@ 60 Hz  
External Clock  
@ 50 Hz, 60 Hz  
@ 50 Hz  
@ 60 Hz  
Common Mode Rejection  
@DC  
@ 50 Hz, 60 Hz2  
@ 50 Hz, 60 Hz2  
80  
94  
90  
dB min  
dB min  
dB min  
90 dB typ, 50 1 Hz, 60 1 Hz, FS[3:0] = 10106  
100 dB typ, 50 1 Hz, FS[3:0] = 10016  
100 dB typ, 60 1 Hz, FS[3:0] = 10006  
AIN = +FS/2  
90  
100  
100  
dB min  
dB min  
dB min  
FS[3:0] = 10106  
50 1 Hz, 60 1 Hz, FS[3:0] = 10106  
50 1 Hz (FS[3:0] = 10016), 60 1 Hz (FS[3:0] =  
10006)  
REV.PrE 6/04 | Page 3  
1234567...21

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