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AD5624R

更新时间： 2024-02-15 13:46:26

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亚德诺 - ADI		/
页数	文件大小	规格书
28页	1067K
描述
Quad, 12-/14-/16-Bit nanoDACs with 5 ppm/C On-Chip Reference

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AD5624R 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP10,.19,20	针数：	10
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	1.77
最大模拟输出电压：	5.5 V	最小模拟输出电压：
转换器类型：	D/A CONVERTER	输入位码：	BINARY
输入格式：	SERIAL	JESD-30 代码：	S-PDSO-G10
JESD-609代码：	e4	长度：	3 mm
最大线性误差 (EL)：	0.0244%	湿度敏感等级：	1
位数：	12	功能数量：	1
端子数量：	10	最高工作温度：	105 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP10,.19,20
封装形状：	SQUARE	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	3/5 V
认证状态：	Not Qualified	座面最大高度：	1.1 mm
最大稳定时间：	4.5 µs	标称安定时间 (tstl)：	3 µs
子类别：	Other Converters	最大压摆率：	0.9 mA
标称供电电压：	3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	3 mm
Base Number Matches：	1

AD5624R 数据手册

AD5624R/AD5644R/AD5664R

TIMING CHARACTERISTICS

All input signals are specified with t_R= t_F= 1 ns/V (10% to 90% of V_DD) and timed from a voltage level of (V_IL+ V_IH)/2 (see Figure 2).

_DD= 2.7 V to 5.5 V; all specifications T_MINto T_MAX, unless otherwise noted.¹

Table 5.

Limit at T_MIN, T_MAX

Parameter

V_DD= 2.7 V to 5.5 V

Unit

Conditions/Comments

SCLK cycle time

SCLK high time

SCLK low time

SYNC to SCLK falling edge setup time

Data setup time

t₁

2±

ns min

t₂

t₃

t₄

t₅

t₆

t₇

t₈

t₉

t_1±

Data hold time

SCLK falling edge to SYNC rising edge

Minimum SYNC high time

SYNC rising edge to SCLK fall ignore

SCLK falling edge to SYNC fall ignore

¹Guaranteed by design and characterization, not production tested.

²Maximum SCLK frequency is 5± MHz at V_DD= 2.7 V to 5.5 V.

TIMING DIAGRAM

t₁₀

t₁

t₉

SCLK

t₂

t₈

t₃

t₇

t₄

SYNC

DIN

t₆

t₅

DB23

DB0

Figure 2. Serial Write Operation

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