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AD5282BRU50

更新时间： 2024-02-25 15:18:55
品牌 Logo 应用领域
亚德诺 - ADI 转换器电位器电阻器光电二极管
页数 文件大小 规格书
10页 154K
描述
+15V, I2C Compatible Digital Potentiometers

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AD5282BRU50 技术参数

Source Url Status Check Date：2013-05-01 14:56:11.546是否无铅： 含铅
是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：MO-153AB, TSSOP-16
针数：16Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.34其他特性：CAN ALSO OPERATE FROM A SINGLE +5V TO +15V SUPPLY; ALSO REQUIRES A +2.7V TO +5.5V LOGIC SUPPLY
标称带宽：0.15 kHz控制接口：2-WIRE SERIAL
转换器类型：DIGITAL POTENTIOMETERJESD-30 代码：R-PDSO-G16
JESD-609代码：e0长度：5 mm
湿度敏感等级：1标称负供电电压：-5 V
功能数量：2位置数：256
端子数量：16最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：240电源：5/15/+-5 V
认证状态：Not Qualified电阻定律：LINEAR
最大电阻容差：30%最大电阻器端电压：5 V
最小电阻器端电压：-5 V座面最大高度：1.2 mm
子类别：Digital Potentiometers标称供电电压：5 V
表面贴装：YES标称温度系数：30 ppm/ °C
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn85Pb15)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
标称总电阻：50000 Ω宽度：4.4 mm
Base Number Matches：1

AD5282BRU50 数据手册

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PRELIMINARY TECHNICAL DATA  
AD5280/AD5282  
9
AD0  
Programmable address bit for multiple  
package decoding. Bits AD0 & AD1  
provide 4 possible addresses.  
TABLE 2: AD5282 PIN Function Descriptions  
Pin  
1
2
Name  
O1  
A1  
Description  
Logic Output terminal O1  
Resistor terminal A1  
Wiper terminal W1  
10  
AD1  
Programmable address bit for multiple  
package decoding. Bits AD0 & AD1  
provide 4 possible addresses.  
Common Ground  
Negative power supply, specified for  
3
W1  
4
5
B1  
VDD  
Resistor terminal B1  
Positive power supply, specified for  
11  
12  
GND  
VSS  
operation from +5 to +15V.  
Active Low, Asynchronous connection of  
the wiper W to terminal B, and open  
circuit of terminal A. RDAC register  
contents unchanged.  
operation from 0 to -5V  
Logic Supply Voltage, needs to be same  
voltage as the digital logic controlling the  
AD5282.  
Resistor terminal B2  
Wiper terminal W2  
6
SHDN  
13  
VL  
14  
15  
16  
B2  
W2  
A2  
7
8
SCL  
SDA  
Serial Clock Input  
Serial Data Input/Output  
Resistor terminal A2  
t8  
SDA  
t1  
t6  
t8  
t9  
SCL  
t2  
t3  
t4  
t5  
t7  
t10  
P
S
Sr  
P
Figure 1. Detail Timing Diagram  
Data of AD5280/AD5282 is accepted from the I2C bus in the following serial format:  
S
0
1
0
1
1
A
D
1
A
D
0
R/  
W
A
R
S
S
D
O
1
O
2
X
X
X
A
D
7
D
6
D
5
D
4
D
3
D
2
D
1
D
0
A
P
A/  
B
Slave Address Byte  
Instruction Byte  
Data Byte  
Where:  
S = Start Condition  
P = Stop Condition  
A = Acknowledge  
X = Don’t Care  
R/W= Read Enable at High and Write Enable at Low  
A/B = RDAC sub address select. “Zero” for RDAC1 and “One” for RDAC2  
SD = Shutdown, same as SHDN pin operation except inverse logic  
O2, O1 = Output logic pin latched values  
AD1, AD0 = Package pin programmable address bits  
D7,D6,D5,D4,D3,D2,D1,D0 = Data Bits  
9
9
9
1
1
1
0
SCL  
SDA  
1
AD1  
AD0  
R/W  
A/B  
RS  
SD  
O1  
O2  
X
D7  
D6  
D5  
D4  
D1  
D0  
1
X
X
D3  
D2  
1
0
ACK. BY  
AD5280  
ACK. BY  
AD5280  
ACK. BY  
AD5280  
START BY  
MASTER  
FRAME 1  
Slave Address Byte  
FRAME  
Instruction Byte  
2
FRAME 3  
Data Byte  
Figure 2. Writing to the RDAC Register  
REV PrE 12 MAR 02  
5
Information contained in this Product Concept Data Sheet describes a product in the early definition stage. There is no guarantee that the information contained here will become a final  
product in its present form. For latest information contact Walt Heinzer/Analog Devices, Santa Clara, CA. TEL 408 382-3107; FAX 408 382-2721; email; walt.heinzer@analog.com  
12345678...10

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型号 品牌 描述 获取价格 数据表
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