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A80L960JF-16

更新时间： 2024-02-20 05:30:43
品牌 Logo 应用领域
英特尔 - INTEL 时钟外围集成电路装置
页数 文件大小 规格书
16页 157K
描述
RISC Microprocessor, 32-Bit, 16.67MHz, CMOS, CPGA132, PGA-132

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A80L960JF-16 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：PGA包装说明：PGA-132
针数：132Reach Compliance Code：unknown
风险等级：5.92其他特性：OPERATING CASE TEMPERATURE 0 TO 100
地址总线宽度：32位大小：32
边界扫描：YES最大时钟频率：16.67 MHz
外部数据总线宽度：32格式：FIXED POINT
集成缓存：NOJESD-30 代码：S-CPGA-P132
JESD-609代码：e0长度：37.08 mm
低功率模式：YESDMA 通道数量：
外部中断装置数量：9串行 I/O 数：
端子数量：132片上数据RAM宽度：8
最高工作温度：100 °C最低工作温度：
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：PGA
封装等效代码：PGA132,14X14封装形状：SQUARE
封装形式：GRID ARRAY峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3.3 V认证状态：Not Qualified
RAM（字数）：512座面最大高度：4.57 mm
速度：16.67 MHz子类别：Microprocessors
最大压摆率：184 mA最大供电电压：3.6 V
最小供电电压：3 V标称供电电压：3.3 V
表面贴装：NO技术：CMOS
温度等级：OTHER端子面层：Tin/Lead (Sn/Pb)
端子形式：PIN/PEG端子节距：2.54 mm
端子位置：PERPENDICULAR处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：37.08 mmuPs/uCs/外围集成电路类型：MICROPROCESSOR, RISC
Base Number Matches：1

A80L960JF-16 数据手册

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80L960JA/JF Microprocessor  
Table 5. 80L960JA/JF AC Characteristics (25 MHz) (Sheet 2 of 2)  
Symbol  
Parameter  
Min  
Max  
Units  
Notes  
RELATIVE OUTPUT TIMINGS  
TLXL  
TLXA  
TDXD  
ALE/ALE# Width  
0.5TC - 7.5  
ns  
ns  
ns  
(9)  
Address Hold from ALE/ALE#  
Inactive  
0.5TC - 7.5  
0.5TC - 7.5  
Equal Loading (9)  
Equal Loading (9)  
DT/R# Valid to DEN# Active  
BOUNDARY SCAN TEST SIGNAL TIMINGS  
TBSF  
TCK Frequency  
TCK High Time  
TCK Low Time  
TCK Rise Time  
TCK Fall Time  
0.5 TF  
MHz  
ns  
TBSCH  
TBSCL  
TBSCR  
TBSCF  
TBSIS1  
15  
15  
5
Measured at 1.5 V (1)  
Measured at 1.5 V (1)  
0.8 V to 2.0 V (1)  
ns  
ns  
5
ns  
2.0 V to 0.8 V (1)  
Input Setup to TCK — TDI, TMS  
4
6
ns  
Input Hold from TCK — TDI,  
TMS  
TBSIH1  
ns  
TBSOV1  
TBSOF1  
TDO Valid Delay  
TDO Float Delay  
3
3
30  
36  
ns  
ns  
(1, 10)  
(1, 10)  
All Outputs (Non-Test) Valid  
Delay  
TBSOV2  
TBSOF2  
TBSIS2  
TBSIH2  
3
3
4
6
35  
36  
ns  
ns  
ns  
ns  
(1, 10)  
(1, 10)  
All Outputs (Non-Test) Float  
Delay  
Input Setup to TCK — All Inputs  
(Non-Test)  
Input Hold from TCK — All Inputs  
(Non-Test)  
NOTE: Refer to Table 6 for note definitions for this table.  
Table 6. Note Definitions for Table 5 “80L960JA/JF AC Characteristics (25 MHz)”  
1. Not tested.  
2. To ensure a 1:1 relationship between the amplitude of the input jitter and the internal clock, the jitter  
frequency spectrum should not have any power peaking between 500 KHz and 1/3 of the CLKIN frequency.  
3. Inactive ALE/ALE# refers to the falling edge of ALE and the rising edge of ALE#. For inactive ALE/ALE#  
timings, refer to Relative Output Timings in Table 5.  
4. A float condition occurs when the output current becomes less than ILO. Float delay is not tested, but is  
designed to be no longer than the valid delay.  
5. AD[31:0] are synchronous inputs. Setup and hold times must be met for proper processor operation. NMI#  
and XINT[7:0]# may be synchronous or asynchronous. Meeting setup and hold time guarantees recognition  
at a particular clock edge. For asynchronous operation, NMI# and XINT[7:0]# must be asserted for a  
minimum of two CLKIN periods to guarantee recognition.  
6. RDYRCV# and HOLD are synchronous inputs. Setup and hold times must be met for proper processor  
operation.  
7. RESET# may be synchronous or asynchronous. Meeting setup and hold time guarantees recognition at a  
particular clock edge.  
8. ONCE# and STEST must be stable at the rising edge of RESET# for proper operation.  
9. Guaranteed by design. May not be 100% tested.  
10.Relative to falling edge of TCK.  
6
Preliminary Online Information, August 1998  
1...3456789...16

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