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Datasheet > 微控制器和处理器 > 时钟发生器> 9FGP202A
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9FGP202A

更新时间： 2024-02-05 07:33:34
品牌 Logo 应用领域
艾迪悌 - IDT /
页数 文件大小 规格书
19页 231K
描述
FREQUENCY TIMING GENERATOR FOR PERIPHERALS

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9FGP202A 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Active零件包装代码：VFQFPN
包装说明：HVQCCN, LCC40,.24SQ,20针数：40
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：1.01
Samacsys Confidence：3Samacsys Status：Released
Samacsys PartID：824243Samacsys Pin Count：41
Samacsys Part Category：Integrated CircuitSamacsys Package Category：Quad Flat No-Lead
Samacsys Footprint Name：NLG40P1Samacsys Released Date：2020-02-02 05:03:22
Is Samacsys：NJESD-30 代码：S-PQCC-N40
JESD-609代码：e3长度：6 mm
湿度敏感等级：3端子数量：40
最高工作温度：70 °C最低工作温度：
最大输出时钟频率：33.33 MHz封装主体材料：PLASTIC/EPOXY
封装代码：HVQCCN封装等效代码：LCC40,.24SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：3.3 V
主时钟/晶体标称频率：25 MHz认证状态：Not Qualified
座面最大高度：1 mm子类别：Clock Generators
最大压摆率：200 mA最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Matte Tin (Sn) - annealed
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：6 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHER
Base Number Matches：1

9FGP202A 数据手册

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9FGP202A  
FREQUENCY TIMING GENERATOR FOR PERIPHERALS  
SMBus Table: Vendor & Revision ID Register  
Pin #  
Byte 6  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Name  
RID3  
RID2  
RID1  
RID0  
VID3  
VID2  
VID1  
VID0  
Control Function  
Type  
R
R
R
R
R
R
R
R
0
-
-
-
-
-
-
-
-
1
-
-
-
-
-
-
-
-
PWD  
-
-
-
-
-
-
-
-
X
X
X
X
0
0
0
1
REVISION ID  
VENDOR ID  
SMBus Table: Device ID  
Byte 7  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Pin #  
Name  
Device ID 7 (MSB)  
Device ID 6  
Control Function  
Type  
RW  
RW  
RW  
RW  
RW  
RW  
RW  
RW  
0
1
PWD  
-
-
-
-
-
-
-
-
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
0
0
1
0
0
0
1
0
Device ID 5  
Device ID 4  
Device ID 3  
Device ID 2  
Device ID  
Device ID 1  
Device ID 0 (LSB)  
SMBus Table: Byte Count Register  
Byte 8  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Pin #  
Name  
BC7  
BC6  
BC5  
BC4  
BC3  
BC2  
BC1  
BC0  
Control Function  
Type  
RW  
RW  
RW  
RW  
RW  
RW  
RW  
RW  
0
-
-
-
-
-
-
-
-
1
-
-
-
-
-
-
-
-
PWD  
-
-
-
-
-
-
-
-
0
0
0
0
1
0
0
1
Writing to this register configures how  
many bytes will be read back.  
SMBus Table: Reserved  
Pin #  
Byte 9  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Name  
Control Function  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Type  
0
1
PWD  
0
0
0
0
0
0
0
0
SMBus Table: PLLs M/N Programming Enable Register  
Byte 10  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Pin #  
-
Name  
M/N_EN  
Control Function  
PLLs M/N Programming Enable  
Reserved  
Type  
RW  
0
1
PWD  
Disable  
Enable  
0
0
0
0
0
0
0
0
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
SMBus Table: CPU PLL VCO Frequency Control Register  
Byte 11  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Pin #  
Name  
N Div8  
N Div 9  
M Div5  
M Div4  
M Div3  
M Div2  
M Div1  
M Div0  
Control Function  
N Divider Prog bit 8  
N Divider Prog bit 9  
Type  
RW  
RW  
RW  
RW  
RW  
RW  
RW  
RW  
0
1
PWD  
X
X
X
X
X
X
X
X
-
-
-
-
-
-
-
-
The decimal representation of M and N  
Divier in Byte 11 and 12 will configure  
the VCO frequency. Default at power up  
= latch-in or Byte 0 Rom table. VCO  
Frequency = 14.318 x [NDiv(9:0)+8] /  
[MDiv(5:0)+2]  
M Divider Programming bits  
IDT® FREQUENCY TIMING GENERATOR FOR PERIPHERALS  
14  
9FGP202A  
REV D 070511  
1...11121314151617...19

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