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9FGP205AKLFT

更新时间： 2024-01-27 20:51:35
品牌 Logo 应用领域
艾迪悌 - IDT /
页数 文件大小 规格书
18页 257K
描述
Frequency Timing Generator for Peripherals

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9FGP205AKLFT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：VFQFPN
包装说明：HVQCCN, LCC40,.24SQ,20针数：40
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：4.51
Samacsys Description：VFQFP-N 6.0 X 6.0 X 0.9 MM - NO LEADJESD-30 代码：S-PQCC-N40
JESD-609代码：e3长度：6 mm
湿度敏感等级：3端子数量：40
最高工作温度：70 °C最低工作温度：
最大输出时钟频率：400 MHz封装主体材料：PLASTIC/EPOXY
封装代码：HVQCCN封装等效代码：LCC40,.24SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：3.3 V
主时钟/晶体标称频率：25 MHz认证状态：Not Qualified
座面最大高度：1 mm子类别：Clock Generators
最大压摆率：225 mA最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：6 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFIC

9FGP205AKLFT 数据手册

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DATASHEET  
Advance Information  
Frequency Timing Generator for Peripherals  
9FGP205  
Pin Configuration  
Recommended Application:  
Peripheral Clock for Intel Servers with Wake-On-Lan support  
Output Features:  
•
•
•
•
•
•
•
1 - 0.7V current-mode differential CPU output  
6 - 50MHz RMII outputs  
2 - 125MHz RGMII outputs  
1 - 0.7V current-mode differential DOT 96MHz output  
1 - 33.33MHz output  
1 - 32.768KHz output  
40 39 38 37 36 35 34 33 32 31  
GND  
GNDRMII  
RMII2  
RMII3  
GNDRMII  
VDDRMII  
RMII4  
RMII5  
VDD33  
33.33MHZ/**SMBADR  
GND33  
1
2
3
4
5
6
7
8
9
30  
29  
28  
27  
26  
25  
24  
23  
22  
21  
VDD96  
DOT96SST  
DOT96SSC  
OE_96  
2 - 25MHz REF outputs  
Key Specifications:  
•
9FGP205  
OE_CPU  
Exact synthesis on CPU, RGMII, RMII & 33.33MHz  
clocks  
+/- 100ppm frequency accuracy on other clocks  
CPUCLKT0  
CPUCLKC0  
VDDCPU  
•
GNDCPU  
10  
11 12 13 14 15 16 17 18 19 20  
Features/Benefits:  
•
•
Selectable SMBus Address - D0/D1 or C0/C1  
Spread Spectrum capability on CPU and DOT 96MHz  
clocks  
40-MLF  
* Internal Pull-Up Resistor  
** Internal Pull-Dow n Resistor  
•
SMBus Control:  
- M/N and spread programming on CPU and DOT  
96MHz clocks via SMBus  
- Differential outputs can be disabled via pins or SMBus  
Functionality  
CPU FS2 CPU FS1 CPU FS0 CPUCLK DOT96SS  
33.33  
MHz  
RMII  
MHz  
RGMII  
MHz  
25  
MHz  
32.768  
KHz  
MHz  
266.67  
133.33  
200.00  
166.67  
333.33  
100.00  
400.00  
Reserved  
MHz  
Byte0 Bit2 Byte0 Bit1 Byte0 Bit0  
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
96.00  
96.00  
96.00  
96.00  
96.00  
96.00  
96.00  
96.00  
33.33  
33.33  
33.33  
33.33  
33.33  
33.33  
33.33  
33.33  
50.00  
50.00  
50.00  
50.00  
50.00  
50.00  
50.00  
50.00  
125.00  
125.00  
125.00  
125.00  
125.00  
125.00  
125.00  
125.00  
25.00  
25.00  
25.00  
25.00  
25.00  
25.00  
25.00  
25.00  
32.768  
32.768  
32.768  
32.768  
32.768  
32.768  
32.768  
32.768  
Power up default is highlighted.  
SMBus Address Selection  
SMBADR  
SMBADR = 0  
SMBADR = 1  
C0/C1  
D0/D1  
IDT® Frequency Timing Generator for Peripherals  
1664—05/14/10  
1
1234567...18

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