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9DBL0242BKILF

更新时间： 2024-01-28 12:04:23

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艾迪悌 - IDT		PC 驱动逻辑集成电路
页数	文件大小	规格书
19页	300K
描述
2-output 3.3V PCIe Zero-Delay Buffer

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9DBL0242BKILF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	VFQFPN
包装说明：	HVQCCN,	针数：	24
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	2.31	Samacsys Description：	Clock Buffer 2 O/P 3.3V PCIE ZERO DELAY BUF
系列：	9DBL	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	S-XQCC-N24	JESD-609代码：	e3
长度：	4 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	24
实输出次数：	4	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE WITH SERIES RESISTOR
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：	260	座面最大高度：	1 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	4 mm	Base Number Matches：	1

9DBL0242 / 9DBL0252 DATASHEET

Test Loads

Terminations

Device

Low-Power Differential Output Test Load

Zo (Ω)

100

Rs (Ω)

None needed

7.5

Prog.

N/A

None needed

Prog.

9DBL0242

9DBL0252

9DBL02P2

9DBL0242

9DBL0252

9DBL02P2

5 inches

Zo=100ohm

2pF

Note: The device can drive transmission line lengths greater

than those specified by the PCIe SIG

Alternate Terminations

The 9DBL family can easily drive LVPECL, LVDS, and CML logic. See “AN-891 Driving LVPECL, LVDS, and CML Logic with

IDT's "Universal" Low-Power HCSL Outputs” for details.

2-OUTPUT 3.3V PCIE ZERO-DELAY BUFFER

FEBRUARY 8, 2017

1 2 345 6 7...19

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型号	品牌	描述	获取价格	数据表
9DBL0242BKILFT	IDT	2-output 3.3V PCIe Zero-Delay Buffer	获取价格
9DBL0243	IDT	2-Output 3.3V LP-HCSL Zero-Delay Buffer with LOS Indicator	获取价格
9DBL0243	RENESAS	2-Output 3.3V PCIe Zero-Delay/Fanout Clock Buffer with Loss of Signal Indicator	获取价格
9DBL0243ANLGI	IDT	2-Output 3.3V LP-HCSL Zero-Delay Buffer with LOS Indicator	获取价格
9DBL0243ANLGI8	IDT	2-Output 3.3V LP-HCSL Zero-Delay Buffer with LOS Indicator	获取价格
9DBL0252	IDT	2-output 3.3V PCIe Zero-Delay Buffer	获取价格