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91309YGT

更新时间： 2024-02-22 00:07:59

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艾迪悌 - IDT		驱动逻辑集成电路
页数	文件大小	规格书
11页	290K
描述
PLL Based Clock Driver

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91309YGT 技术参数

生命周期：	Active	Reach Compliance Code：	compliant
风险等级：	5.68	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
Base Number Matches：	1

91309YGT 数据手册

ICS91309

Pin Descriptions

PIN # PIN NAME

PIN TYPE DESCRIPTION

REF¹

Input reference frequency, 5V tolerant input

CLKA1²

OUT

PWR

OUT

Buffered clock output, Bank A

Power Supply

CLKA2²

4, 13 VDD

5, 12 GND

Ground

CLKB1²

Buffered clock output, Bank B

Function select input, bit 2

Function select input, bit 1

Buffered clock output, Bank B

Buffered clock output, Bank A

Buffered clock output, internal feedback

CLKB2²

FS2³

FS1³

CLKB3²

OUT

CLKB4²

CLKA3²

CLKA4²

CLKOUT²

Notes:

1. Weak pull-down

2. Weak pull-down on all outputs

3. Weak pull-ups on these inputs

0093H—12/09/08

123 4 5 6 7...11

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91310-01M	COOPER	获取价格	Analog Circuit
91310-01M-1	COOPER	获取价格	Analog Circuit
91310-05M	COOPER	获取价格	Analog Circuit
91315-01M-1	COOPER	获取价格	Analog Circuit
91315-01M-2	COOPER	获取价格	Analog Circuit
91315-01P-1	COOPER	获取价格	Analog Circuit
91315-05M	COOPER	获取价格	Analog Circuit