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91309YGLFT

更新时间： 2024-01-05 20:09:49

品牌	Logo	应用领域
艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
10页	108K
描述
PLL Based Clock Driver, 91309 Series, 4 True Output(s), 0 Inverted Output(s), PDSO8, LEAD FREE, TSSSOP-8

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91309YGLFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	End Of Life	零件包装代码：	SOIC
包装说明：	LEAD FREE, TSSSOP-8	针数：	8
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.68	Is Samacsys：	N
系列：	91309	输入调节：	STANDARD
JESD-30 代码：	R-PDSO-G8	JESD-609代码：	e3
长度：	5 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
功能数量：	1	反相输出次数：
端子数量：	8	实输出次数：	4
最高工作温度：	70 °C	最低工作温度：
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.7 ns
座面最大高度：	1.2 mm	最大供电电压 (Vsup)：	3.4 V
最小供电电压 (Vsup)：	3.2 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
最小 fmax：	133 MHz	Base Number Matches：	1

91309YGLFT 数据手册

ICS91309

Integrated

Circuit

Systems,Inc.

High Performance Communication Buffer

General Description

Features

The ICS91309 is a high performance, low skew, low jitter

zero delay buffer. It uses a phase lock loop (PLL)

technologytoalign, inbothphaseandfrequency, theREF

input with the CLKOUT signal. It is designed to distribute

high speed clocks in communication systems operating

at speeds from 10 to 133 MHz.

•

Zero input - output delay

Frequency range 10 - 133 MHz (3.3V)

5V tolerant input REF

High loop filter bandwidth ideal for Spread Spectrum

applications.

•

Less than 125 ps cycle to cycle Jitter

Skew controlled outputs

Available in 16 pin, 150 mil SSOP, SOIC & 4.40mm

TSSOP packages

The ICS91309 provides synchronization between the

input and output. The synchronization is established via

CLKOUTfeedbacktotheinputofthePLL. Sincetheskew

between the input and output is less than +/- 350 pS, the

part acts as a zero delay buffer.

•

Skew:Group-to-Group:<215ps

Skew within Group: <100 ps

Commercial temperature range: 0°C to +70°C

ICS91309 hastwobanksoffouroutputscontrolledbytwo

address lines. Depending on the selected address line,

bankBorbothbankscanbeputinatri-statemode. Inthis

mode, the PLL is still running and only the output buffers

are put in a high impedance mode. The test mode shuts

off the PLL and connects the input directly to the output

buffers (see table below for functionality).

Pin Configuration

REF

CLKA1

CLKA2

VDD

CLKOUT

CLKA4

CLKA3

VDD

ICS91309 comes in a 16-pin 150 mil SOIC, SSOP or

4.40mm TSSOP package. In the absence of REF input,

thedevicewillenterapowerdownmode. Inthismode, the

PLL is turned off and the output buffers are pulled low.

Powerdownmodeprovidesthelowestpowerconsumption

for a standby condition.

GND

CLKB1

CLKB2

FS2

CLKB4

CLKB3

FS1

Block Diagram

16 pin SSOP, SOIC & TSSOP

Functionality

Ouput

Source Shutdown

PLL

FS2 FS1 CLKA(1:4) CLKB(1:4) CLKOUT

Tristate

Driven

PLL

Bypass

Mode

Tristate

Driven

PLL

Bypass

Mode

Driven

PLL

PLL Bypass

Mode

REF

PLL

Driven

0093H—12/09/08

12 3 4 5 6 7...10

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与91309YGLFT相关器件

型号	品牌	描述	获取价格	数据表
91309YGT	IDT	PLL Based Clock Driver	获取价格
91309YMLFT	IDT	PLL Based Clock Driver, 91309 Series, 4 True Output(s), 0 Inverted Output(s), PDSO8, 0.150	获取价格
91309YMT	IDT	PLL Based Clock Driver	获取价格
9130R thru 9149R	MACOM	9100 Series Capacitors Working Voltage > 100V	获取价格
91310-01M	COOPER	Analog Circuit	获取价格
91310-01M-1	COOPER	Analog Circuit	获取价格

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