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874003BG-05LFT

更新时间： 2024-02-16 19:23:32

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艾迪悌 - IDT		衰减器 PC
页数	文件大小	规格书
18页	803K
描述
PCI EXPRESS™ JITTER ATTENUATOR

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874003BG-05LFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Lifetime Buy	零件包装代码：	TSSOP
包装说明：	6.50 X 4.40 MM, 0.925 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-20	针数：	20
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.44
系列：	5V	输入调节：	STANDARD
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e3
长度：	6.5 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
湿度敏感等级：	1	功能数量：	1
反相输出次数：	3	端子数量：	20
实输出次数：	3	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.145 ns
座面最大高度：	1.2 mm	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn) - annealed	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
最小 fmax：	98 MHz	Base Number Matches：	1

874003BG-05LFT 数据手册

ICS874003-05

PCI EXPRESS™ JITTER ATTENUATOR

Table 1. Pin Descriptions

Number

1, 20

Name

QA1, nQA1

V_DDO

Type

Description

Output

Power

Bank A differential output pair. LVDS interface levels.

Output supply pins.

2, 19

3, 4

QA0, nQA0

Output

Bank A differential output pair. LVDS interface levels.

Active HIGH Master Reset. When logic HIGH, the internal dividers are reset

causing the true outputs (nQx) to go low and the inverted outputs (Qx) to go

high. When logic LOW, the internal dividers and the outputs are enabled.

LVCMOS/LVTTL interface levels.

Input

Pulldown

F_SEL0,

F_SEL1,

F_SEL2

Frequency select pin for QAx/nQAx and QB0/nQB0 outputs.

LVCMOS/LVTTL interface levels.

Input

Pulldown

Unused

Power

No connect.

V_DDA

V_DD

Analog supply pin.

Core supply pin.

Output enable pin for QA pins. When HIGH, the QAx/nQAx outputs are active.

When LOW, the QAx/nQAx outputs are in a high-impedance state.

LVCMOS/LVTTL interface levels.

OEA

Input

Pullup

CLK

nCLK

GND

Input

Pulldown

Pullup

Non-inverting differential clock input.

Inverting differential clock input.

Power supply ground.

Power

Output enable pin for QB0 pins. When HIGH, the QB0/nQB0 outputs are active.

When LOW, the QB0/nQB0 outputs are in a high-impedance state.

LVCMOS/LVTTL interface levels.

OEB

Input

Pullup

17, 18

nQB0, QB0

Output

Bank B differential output pair. LVDS interface levels.

NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.

Table 2. Pin Characteristics

Symbol

C_IN

Parameter

Test Conditions

Minimum

Typical

Maximum

Units

Input Capacitance

Input Pullup Resistor

R_PULLUP

kΩ

R_PULLDOWNInput Pulldown Resistor

kΩ

Table 3. Output Enable Function Table

Inputs

Outputs

QA[0:1], nQA[0:1]

OEA

OEB

QB0, nQB0

High Impedance

Enabled

High Impedance

Enabled

1 (default)

IDT™ / ICS™ PCI EXPRESS™ JITTER ATTENUATOR

ICS874003BG-05 REV. A APRIL 15, 2009

1 234 5 6 7...18

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