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84C644

更新时间： 2024-01-10 17:16:59
品牌 Logo 应用领域
恩智浦 - NXP 微控制器和处理器外围集成电路光电二极管时钟
页数 文件大小 规格书
40页 237K
描述
8-bit microcontrollers with OSD and VST

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84C644 技术参数

生命周期：Active零件包装代码：DIP
包装说明：SDIP,针数：42
Reach Compliance Code：unknownHTS代码：8542.31.00.01
风险等级：5.8Is Samacsys：N
具有ADC：YES地址总线宽度：
位大小：8最大时钟频率：10 MHz
DMA 通道：YES外部数据总线宽度：
JESD-30 代码：R-PDIP-T42长度：38.65 mm
I/O 线路数量：28端子数量：42
PWM 通道：YES封装主体材料：PLASTIC/EPOXY
封装代码：SDIP封装形状：RECTANGULAR
封装形式：IN-LINE, SHRINK PITCH认证状态：Not Qualified
ROM可编程性：MROM座面最大高度：5.08 mm
速度：10 MHz最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
表面贴装：NO技术：CMOS
端子形式：THROUGH-HOLE端子节距：1.778 mm
端子位置：DUAL宽度：15.24 mm
uPs/uCs/外围集成电路类型：MICROCONTROLLERBase Number Matches：1

84C644 数据手册

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Philips Semiconductors  
Product specification  
8-bit microcontrollers with OSD and VST  
84C44X; 84C64X; 84C84X  
8
ANALOG CONTROL  
6-bit PWM DACs  
8.1.3  
ANALOG OUTPUT VOLTAGE  
A DC voltage proportional to the PWM control setting may  
be obtained by connecting an integrating network to each  
of the PWM outputs (see Fig.9).  
8.1  
Five PWM outputs are available for analog control  
purposes e.g. volume, balance, brightness, saturation, etc.  
The block diagram of a typical 6-bit PWM DAC is shown in  
Fig.8. Each PWM output can generate pulses of  
The analog value is calculated as follows:  
t
VA  
=
HIGH × V  
programmable length that have a repetition frequency of  
-------------  
O
1
64 × fPWM, where fPWM = 1⁄3 × fXTAL  
.
tr  
⁄
Where:  
8.1.1  
PIN SELECTION FOR PWM OUTPUTS  
•
The PWM outputs PWM1 to PWM5, share the same pins  
as the Derivative Port lines DP0.1 to DP0.5.  
t HIGH = t0 × PWMDL = HIGH time of the PWM pulse  
Setting the (relevant PWM enable) bit PWMnE to:  
• Logic 1, selects the relevant PWMx output function  
• Logic 0, selects the relevant DP0.x Port function.  
• tr = t0 × 64 = repetition time of the PWM pulse  
3
• t0  
=
-------------  
fXTAL  
8.1.2  
POLARITY OF THE PWM OUTPUTS  
• PWMDL is the decimal value of the contents of the  
PWM data latch.  
The polarity of all five PWM outputs is selected by the state  
of the polarity control bit P6LVL.  
Therefore, the analog output voltage is:  
PWMDL  
Setting the control bit P6LVL to:  
• Logic 0, sets the PWMx outputs to the default polarity  
• Logic 1, inverts all the PWMx outputs.  
V A  
=
× V  
O
-----------------------  
64  
DP0.x data  
I/O  
f
6-BIT PWM DATA LATCH  
PWM  
PWMnE  
Q
Q
6-BIT DAC PWM  
CONTROLLER  
DP0.x/PWMx  
polarity control bit  
P6LVL  
MCD176  
Fig.8 Block diagram of the 6-bit PWM DAC.  
10  
1996 Nov 29  
1...78910111213...40

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