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843021AG

更新时间： 2024-01-29 21:57:36

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艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
15页	856K
描述
Clock Generator, 140MHz, PDSO8, 4.40 X 3 MM, 0.925 MM HEIGHT, MO-153, TSSOP-8

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843021AG 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	End Of Life	零件包装代码：	TSSOP
包装说明：	4.40 X 3 MM, 0.925 MM HEIGHT, MO-153, TSSOP-8	针数：	8
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.22
Is Samacsys：	N	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e0	长度：	4.4 mm
湿度敏感等级：	1	端子数量：	8
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	140 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP8,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	240	电源：	3.3 V
主时钟/晶体标称频率：	40 MHz	认证状态：	Not Qualified
座面最大高度：	1.2 mm	子类别：	Clock Generators
最大压摆率：	85 mA	最大供电电压：	3.63 V
最小供电电压：	2.97 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	20
宽度：	3 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

843021AG 数据手册

ICS843021 Data Sheet

FEMTOCLOCK^®CRYSTAL-TO-3.3V LVPECL CLOCK GENERATOR

Schematic Example

Figure 5A shows a schematic example of using an ICS843021. An

example of LVPECL termination is shown in this schematic.

Additional LVPECL termination approaches are shown in the

LVPECL Termination Application Note. In this example, an 18pF

parallel resonant crystal is used for generating 125MHz output

frequency. TheC1 = 27pF and C2 = 33pF are recommended for

frequency accuracy. For a different board layout, the C1 and C2

values may be slightly adjusted for optimizing frequency accuracy.

Figure 5. ICS843021 Schematic Example

Schematic Example

Figure 5B shows an example of ICS843021 P.C. board layout. The

crystal X1 footprint shown in this example allows installation of either

surface mount HC49S or through-hole HC49 package. The footprints

of other components in this example are listed in the Table 7 There

should be at least one decoupling capacitor per power pin. The

decoupling capacitors should be located as close as possible to the

power pins. The layout assumes that the board has clean analog

power ground plane.

Table 7. Footprint Table

Reference

C1, C2

Size

0402

0805

0603

C4, C5

NOTE: Table 7 lists component sizes

shown in this layout example.

Figure 5B. ICS843021 PC Board Layout Example

ICS843021AG REVISION D OCTOBER 12, 2010

1...6 7 8910 11 12...15

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