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8403701DA

更新时间： 2024-01-28 08:09:20

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德州仪器 - TI		逻辑集成电路输入元件
页数	文件大小	规格书
18页	695K
描述
QUADRUPLE 2-INPUT POSITIVE-NAND GATES

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技术参数
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8403701DA 技术参数

生命周期：	Active	包装说明：	,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.32	系列：	HC/UH
长度：	8.89 mm	逻辑集成电路类型：	NAND GATE
功能数量：	4	输入次数：	2
端子数量：	20	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装形式：	CHIP CARRIER	峰值回流温度（摄氏度）：	NOT APPLICABLE
传播延迟（tpd）：	135 ns	认证状态：	Qualified
座面最大高度：	2.03 mm	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
技术：	CMOS	温度等级：	MILITARY
端子节距：	1.27 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT APPLICABLE	宽度：	8.89 mm
Base Number Matches：	1

8403701DA 数据手册

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SCLS181E − DECEMBER 1982 − REVISED AUGUST 2003

PARAMETER MEASUREMENT INFORMATION

From Output

Under Test

Test

Point

Input

50%

0 V

= 50 pF

PLH

PHL

90%

(see Note A)

In-Phase

Output

90%

50%

10%

50%

10%

LOAD CIRCUIT

PLH

PHL

90%

Input

50%

10%

50%

10%

90%

Out-of-Phase

Output

50%

10%

50%

10%

0 V

VOLTAGE WAVEFORM

INPUT RISE AND FALL TIMES

VOLTAGE WAVEFORMS

PROPAGATION DELAY AND OUTPUT TRANSITION TIMES

NOTES: A.

B. Phase relationships between waveforms were chosen arbitrarily. All input pulses are supplied by generators having the following

characteristics: PRR ≤ 1 MHz, Z = 50 Ω, t = 6 ns, t = 6 ns.

C includes probe and test-fixture capacitance.

C. The outputs are measured one at a time with one input transition per measurement.

D. and t are the same as t

PLH

PHL pd

Figure 1. Load Circuit and Voltage Waveforms

POST OFFICE BOX 655303 • DALLAS, TEXAS 75265

1 2 345 6 7...18

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型号	品牌	描述	获取价格	数据表
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