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Datasheet > 微控制器和处理器 > 时钟发生器> 8402010AKILF
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8402010AKILF

更新时间： 2024-01-31 13:54:58
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艾迪悌 - IDT 时钟发生器
页数 文件大小 规格书
16页 316K
描述
FEMTOCLOCK™ CRYSTAL-TOLVDS/LVCMOS CLOCK GENERATOR

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8402010AKILF 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Active零件包装代码：QFN
包装说明：VQCCN, LCC32,.2SQ,20针数：32
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.21
JESD-30 代码：S-XQCC-N32JESD-609代码：e0
长度：5 mm湿度敏感等级：3
端子数量：32最高工作温度：85 °C
最低工作温度：-40 °C最大输出时钟频率：62.5 MHz
封装主体材料：UNSPECIFIED封装代码：VQCCN
封装等效代码：LCC32,.2SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, VERY THIN PROFILE峰值回流温度（摄氏度）：225
电源：3.3 V主时钟/晶体标称频率：25 MHz
认证状态：Not Qualified座面最大高度：1 mm
子类别：Clock Generators最大压摆率：25 mA
最大供电电压：3.465 V最小供电电压：3.135 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn85Pb15)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：5 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHERBase Number Matches：1

8402010AKILF 数据手册

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ICS8402010I  
FEMTOCLOCK™ CRYSTAL-TO-LVDS/LVCMOS CLOCK GENERATOR  
APPLICATION INFORMATION  
POWER SUPPLY FILTERING TECHNIQUES  
As in any high speed analog circuitry, the power supply pins are  
vulnerable to random noise. To achieve optimum jitter perfor-  
mance, power supply isolation is required. The ICS8402010I pro-  
vides separate power supplies to isolate any high switching noise  
from the outputs to the internal PLL. VDD, VDDA and VDDO_X should  
be individually connected to the power supply plane through  
vias, and 0.01µF bypass capacitors should be used for each pin.  
Figure 1 illustrates this for a generic VCC pin and also shows that  
VDDA requires that an additional 10Ω resistor along with a 10µF  
bypass capacitor be connected to the VDDA pin.  
3.3V  
VDD  
.01μF  
.01μF  
10Ω  
VDDA  
10μF  
FIGURE 1. POWER SUPPLY FILTERING  
RECOMMENDATIONS FOR UNUSED INPUT AND OUTPUT PINS  
INPUTS:  
OUTPUTS:  
LVCMOS OUTPUTS  
LVCMOS CONTROL PINS  
All unused LVCMOS output can be left floating. There should be  
no trace attached.  
Control pins have internal pullups or pulldowns; additional  
resistance is not required but can be added for additional  
protection. A 1kΩ resistor can be used.  
LVDS OUTPUTS  
All unused LVDS outputs should be terminated with 100Ω resistor  
between the differential pair.  
IDT™ / ICS™ LVDS/LVCMOS CLOCK GENERATOR  
8
ICS8402010AKI REV. A AUGUST 28, 2008  
1...567891011...16

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8402010AKILFT IDT

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