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813252DKI-02LF

更新时间： 2024-01-21 23:52:16

品牌	Logo	应用领域
艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
23页	1268K
描述
Clock Generator, 312.5MHz, 5 X 5 MM, 0.925 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD-2, VFQFN-32

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813252DKI-02LF 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	QFN	包装说明：	5 X 5 MM, 0.925 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD-2, VFQFN-32
针数：	32	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.23	JESD-30 代码：	S-XQCC-N32
长度：	5 mm	端子数量：	32
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	312.5 MHz	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	主时钟/晶体标称频率：	155.52 MHz
认证状态：	Not Qualified	座面最大高度：	1 mm
最大供电电压：	3.465 V	最小供电电压：	3.135 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	5 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

813252DKI-02LF 数据手册

ICS813252DI-02 Data Sheet

VCXO JITTER ATTENUATOR & FEMTOCLOCK^®MULTIPLIER

Table 1. Pin Descriptions

Number

Name

Type

Description

Analog

Input/Output

1, 2

LF1, LF0

Loop filter connection node pins. LF0 is the output. LF1 is the input.

Analog

Input/Output

ISET

V_EE

Charge pump current setting pin.

Negative supply pins.

4, 8, 18, 24

Power

Input clock select. When HIGH selects CLK1, nCLK1. When LOW, selects

CLK0, nCLK0. LVCMOS / LVTTL interface levels.

CLK_SEL

Input

Pulldown

Pullup

6, 12, 27

V_CC

Power

Core supply pins.

RESERVED

Reserve

Reserved pin. Do not connect.

10,

PDSEL_2,

PDSEL_1,

PDSEL_0

Pre-divider select pins. LVCMOS/LVTTL interface levels.

See Table 3A.

Input

V_CCA

Power

Input

Analog supply pin.

14,

ODBSEL_1,

ODBSEL_0

Frequency select pins for Bank B output. See Table 3B. LVCMOS/LVTTL

interface levels.

Pulldown

16,

ODASEL_1,

ODASEL_0

Frequency select pins for Bank A output. See Table 3B. LVCMOS/LVTTL

interface levels.

Input

19, 20

QA, nQA

V_CCO

Output

Power

Output

Differential Bank A clock outputs. LVPECL interface levels.

Output supply pin.

22, 23

QB, nQB

Differential Bank B clock outputs. LVPECL interface levels.

Pullup/

Pulldown

nCLK1

CLK1

Input

Power

Inverting differential clock input. V_CC/2 bias voltage when left floating.

Pulldown Non-inverting differential clock input.

Pullup/

nCLK0

CLK0

Inverting differential clock input. V_CC/2 bias voltage when left floating.

Pulldown

Pulldown Non-inverting differential clock input.

30,

XTAL_OUT,

XTAL_IN

Crystal oscillator interface. XTAL_IN is the input. XTAL_OUT is the output.

Power supply pin for VCXO charge pump.

V_CCX

NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.

Table 2. Pin Characteristics

Symbol

C_IN

Parameter

Test Conditions

Minimum

Typical

Maximum

Units

Input Capacitance

Input Pullup Resistor

R_PULLUP

kΩ

R_PULLDOWNInput Pulldown Resistor

kΩ

ICS813252DKI-02 REVISION A JANUARY 25, 2011

1 234 5 6 7...23

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型号	品牌	描述	获取价格	数据表
813252DKI-02LFT	IDT	Clock Generator, 312.5MHz, 5 X 5 MM, 0.925 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD-2, VFQFN-	获取价格
813253AG	IDT	Clock Generator, 340MHz, PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, TSSOP-24	获取价格
813253AGLF	IDT	Clock Generator, 340MHz, PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, TSSOP-24	获取价格
813253AGT	IDT	Clock Generator, 340MHz, PDSO24, 4.40 X 7.80 MM, 0.92 MM HEIGHT, TSSOP-24	获取价格
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