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80C32-16

更新时间： 2024-01-31 11:33:39

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20页	221K
描述
CMOS 0 to 44 MHz Single Chip 8?bit Microntroller

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80C32-16 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
包装说明：	DIP, DIP40,.6	Reach Compliance Code：	unknown
风险等级：	5.89	位大小：	8
CPU系列：	8051	JESD-30 代码：	R-XDIP-T40
JESD-609代码：	e0	端子数量：	40
最高工作温度：	125 °C	最低工作温度：	-55 °C
封装主体材料：	CERAMIC	封装代码：	DIP
封装等效代码：	DIP40,.6	封装形状：	RECTANGULAR
封装形式：	IN-LINE	电源：	5 V
认证状态：	Not Qualified	RAM（字节）：	256
ROM（单词）：	0	筛选级别：	38535Q/M;38534H;883B
速度：	16 MHz	子类别：	Microcontrollers
最大压摆率：	39 mA	标称供电电压：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	MILITARY	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL

80C32-16 数据手册

80C32/80C52

Explanation of the AC Symbol

Each timing symbol has 5 characters. The first character Example :

is always a “T” (stands for time). The other characters,

TAVLL = Time for Address Valid to ALE low.

TLLPL = Time for ALE low to PSEN low.

depending on their positions, stand for the name of a

signal or the logical status of that signal. The following

is a list of all the characters and what they stand for.

A : Address.

C : Clock.

D : Input data.

Q : Output data.

R : READ signal.

T : Time.

H : Logic level HIGH

I : Instruction (program memory contents).

L : Logic level LOW, or ALE.

P : PSEN.

V : Valid.

W : WRITE signal.

X : No longer a valid logic level.

Z : Float.

AC Parameters

TA = 0 to + 70°C ; Vss = 0 V ; Vcc = 5 V ± 10 % ; F = 0 to 44 MHz

TA = 0 to +70°C ; Vss = 0 V ; 2.7 V < Vcc < 5.5 V ; F = 0 to 16 MHz

TA = –40° to + 85°C ; Vss = 0 V ; 2.7 V < Vcc < 5.5 V ; F = 0 to 16 MHz

TA = –55° + 125°C ; Vss = 0 V ; Vcc = 5 V ± 10 % ; F = 0 to 36 MHz

(Load Capacitance for PORT 0, ALE and PSEN = 100 pF ; Load Capacitance for all other outputs = 80 pF)

External Program Memory Characteristics (values in ns)

16 MHz 20 MHz 25 MHz 30 MHz 36 MHz 40 MHz 42 MHz 44 MHz

min max min max min max min max min max min max min max min max

SYM-

BOL

PARAMETER

TLHLL ALE Pulse Width

110

TAVLL Address valid to ALE

TLLAX Address Hold After ALE

TLLIV

ALE to valid instr in

185

170

130

100

TLLPL ALE to PSEN

TPLPH PSEN pulse Width

165

130

100

TPLIV

TPXIX

TPXIZ

PSEN to valid instr in

125

110

Input instr Hold After PSEN

Input instr Float After PSEN

TPXAV PSEN to Address Valid

TAVIV Address to Valid instr in

TPLAZ PSEN low to Address Float

230

210

170

130

External Program Memory Read Cycle

TAVIV

MATRA MHS

Rev. G (14 Jan. 97)

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