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80C32-12D

更新时间： 2024-01-18 03:52:06

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TEMIC		微控制器
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20页	227K
描述
CMOS 0 to 44 MHz Single-chip 8 Bit Microcontroller

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80C32-12D 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
包装说明：	QCCJ, LDCC44,.7SQ	Reach Compliance Code：	unknown
风险等级：	5.84	Is Samacsys：	N
位大小：	8	CPU系列：	8051
JESD-30 代码：	S-XQCC-J44	JESD-609代码：	e0
端子数量：	44	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	CERAMIC
封装代码：	QCCJ	封装等效代码：	LDCC44,.7SQ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
电源：	5 V	认证状态：	Not Qualified
RAM（字节）：	256	ROM（单词）：	0
筛选级别：	38535Q/M;38534H;883B	速度：	12 MHz
子类别：	Microcontrollers	最大压摆率：	35 mA
标称供电电压：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	J BEND
端子节距：	1.27 mm	端子位置：	QUAD
Base Number Matches：	1

80C32-12D 数据手册

MATRA MHS

80C32/80C52

Explanation of the AC Symbol

Each timing symbol has 5 characters. The first character Example :

is always a “T” (stands for time). The other characters,

TAVLL = Time for Address Valid to ALE low.

TLLPL = Time for ALE low to PSEN low.

depending on their positions, stand for the name of a

signal or the logical status of that signal. The following

is a list of all the characters and what they stand for.

A : Address.

C : Clock.

D : Input data.

Q : Output data.

R : READ signal.

T : Time.

H : Logic level HIGH

I : Instruction (program memory contents).

L : Logic level LOW, or ALE.

P : PSEN.

V : Valid.

W : WRITE signal.

X : No longer a valid logic level.

Z : Float.

AC Parameters

TA = 0 to + 70°C ; Vss = 0 V ; Vcc = 5 V ± 10 % ; F = 0 to 44 MHz

TA = 0 to +70°C ; Vss = 0 V ; 2.7 V < Vcc < 5.5 V ; F = 0 to 16 MHz

TA = –40° to + 85°C ; Vss = 0 V ; 2.7 V < Vcc < 5.5 V ; F = 0 to 16 MHz

TA = –55° + 125°C ; Vss = 0 V ; Vcc = 5 V ± 10 % ; F = 0 to 36 MHz

(Load Capacitance for PORT 0, ALE and PSEN = 100 pF ; Load Capacitance for all other outputs = 80 pF)

External Program Memory Characteristics (values in ns)

16 MHz 20 MHz 25 MHz 30 MHz 36 MHz 40 MHz 42 MHz 44 MHz

min max min max min max min max min max min max min max min max

SYM-

BOL

PARAMETER

TLHLL ALE Pulse Width

110

TAVLL Address valid to ALE

TLLAX Address Hold After ALE

TLLIV

ALE to valid instr in

185

170

130

100

TLLPL ALE to PSEN

TPLPH PSEN pulse Width

165

130

100

TPLIV

TPXIX

TPXIZ

PSEN to valid instr in

125

110

Input instr Hold After PSEN

Input instr Float After PSEN

TPXAV PSEN to Address Valid

TAVIV Address to Valid instr in

TPLAZ PSEN low to Address Float

230

210

170

130

External Program Memory Read Cycle

Rev. E (31/08/95)

1...12 13 141516 17 18...20

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