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74VHC273MTC PDF预览

74VHC273MTC

更新时间： 2024-02-28 01:33:48
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 触发器锁存器逻辑集成电路光电二极管
页数 文件大小 规格书
7页 94K
描述
Octal D-Type Flip-Flop

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74VHC273MTC 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Transferred零件包装代码：TSSOP
包装说明：TSSOP, TSSOP20,.25针数：20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.05
Is Samacsys：N系列：AHC/VHC
JESD-30 代码：R-PDSO-G20JESD-609代码：e4
长度：6.5 mm负载电容（CL）：50 pF
逻辑集成电路类型：D FLIP-FLOP最大频率@ Nom-Sup：75000000 Hz
最大I（ol）：0.008 A湿度敏感等级：1
位数：8功能数量：1
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP20,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH包装方法：RAIL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：2/5.5 V
Prop。Delay @ Nom-Sup：12.5 ns传播延迟（tpd）：17.1 ns
认证状态：Not Qualified座面最大高度：1.2 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：4.4 mm
最小 fmax：100 MHzBase Number Matches：1

74VHC273MTC 数据手册

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April 1994  
Revised April 1999  
74VHC273  
Octal D-Type Flip-Flop  
age. This device can be used to interface 5V to 3V systems  
and two supply systems such as battery backup. This cir-  
cuit prevents device destruction due to mismatched supply  
and input voltages.  
General Description  
The VHC273 is an advanced high speed CMOS Octal D-  
type flip-flop fabricated with silicon gate CMOS technology.  
It achieves the high speed operation similar to equivalent  
Bipolar Schottky TTL while maintaining the CMOS low  
power dissipation.  
Features  
■ High Speed: fMAX= 165 MHz (typ) at VCC = 5V  
■ Low power dissipation: ICC = 4 µA (max) at TA = 25°C  
■ High noise immunity: VNIH = VNIL = 28% VCC (min)  
The register has a common buffered Clock (CP) which is  
fully edge-triggered. The state of each D input, one setup  
time before the LOW-to-HIGH clock transition, is trans-  
ferred to the corresponding flip-flop’s Q output. The Master  
Reset (MR) input will clear all flip-flops simultaneously. All  
outputs will be forced LOW independently of Clock or Data  
inputs by a LOW voltage level on the MR input.  
■ Power down protection is provided on all inputs  
■ Low noise: VOLP = 0.9V (max)  
■ Pin and function compatible with 74HC273  
An input protection circuit insures that 0V to 7V can be  
applied to the inputs pins without regard to the supply volt-  
Ordering Code:  
Order Number Package Number  
Package Description  
74VHC273M  
74VHC273SJ  
74VHC273MTC  
74VHC273N  
M20B  
M20D  
MTC20  
N20A  
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300 Wide  
20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide  
20-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide  
20-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
Surface mount packages are also available on Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.  
Logic Symbols  
Connection Diagram  
IEEE/IEC  
Pin Descriptions  
Pin Names  
Description  
D0–D7  
Data Inputs  
Master Reset  
MR  
CP  
Clock Pulse Input  
Data Outputs  
Q0–Q7  
© 1999 Fairchild Semiconductor Corporation  
DS011670.prf  
www.fairchildsemi.com  
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74VHC273MTC 替代型号

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