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Datasheet > 信号电路 > 其他模拟IC> 74HCT5555DB-T
74HCT5555DB-T PDF预览

74HCT5555DB-T

更新时间： 2024-02-16 12:32:31
品牌 Logo 应用领域
恩智浦 - NXP 振荡器
页数 文件大小 规格书
23页 146K
描述
IC SPECIALTY ANALOG CIRCUIT, PDSO16, Analog IC:Other

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74HCT5555DB-T 技术参数

生命周期：Obsolete包装说明：SOP,
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.59模拟集成电路 - 其他类型：ANALOG CIRCUIT
JESD-30 代码：R-PDSO-G16功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE认证状态：Not Qualified
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子形式：GULL WING端子位置：DUAL
Base Number Matches：1

74HCT5555DB-T 数据手册

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Philips Semiconductors  
Product specification  
Programmable delay timer with oscillator  
74HC/HCT5555  
AC CHARACTERISTICS FOR 74HC  
GND = 0 V; tr = tf = 6 ns; CL = 50 pF.  
Tamb (°C)  
TEST CONDITION  
SYMBOL PARAMETER  
+25  
−40 to +85  
−40 to +125 UNIT  
VCC  
WAVEFORMS  
(V)  
MIN TYP MAX MIN MAX MIN MAX  
t
PLH/tPHL  
propagation  
delay A, B to  
Q, Q  
−
−
−
77  
28  
22  
240  
48  
41  
−
−
−
300  
60  
51  
−
−
−
360  
72  
61  
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.6  
tPLH/tPHL  
propagation  
delay MR to Q,  
Q
−
−
−
61  
22  
18  
185  
37  
31  
−
−
−
230  
46  
39  
−
−
−
280  
56  
48  
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.7  
t
t
PLH/tPHL  
propagation  
delay RS to Q,  
Q
−
−
−
83  
30  
24  
250  
50  
43  
−
−
−
315  
63  
54  
−
−
−
375  
75  
64  
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.8; note 1  
Fig.6  
THL/tTLH  
output  
transition time  
−
−
−
19  
7
6
75  
15  
13  
−
−
−
95  
19  
16  
−
−
−
110  
22  
19  
ns  
ns  
ns  
2.0  
4.5  
6.0  
tW  
trigger pulse  
width  
A = HIGH  
70  
14  
12  
17  
6
5
−
−
−
90  
18  
15  
−
−
−
105  
21  
18  
−
−
−
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.6  
B = LOW  
tW  
tW  
tW  
master reset  
pulse width  
HIGH  
70  
14  
12  
19  
7
6
−
−
−
90  
18  
15  
−
105  
21  
18  
−
−
−
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.7  
clock pulse  
width RS;  
HIGH or LOW  
80  
16  
14  
25  
9
7
−
−
−
100  
20  
17  
−
−
−
120  
24  
20  
−
−
−
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.8  
minimum  
output pulse  
width  
−
−
−
275  
100  
80  
−
−
−
−
−
−
−
−
−
−
−
−
−
−
−
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.6; note 1  
Q = HIGH,  
Q = LOW  
trt  
retrigger time  
A, B  
−
−
−
0
0
0
−
−
−
−
−
−
−
−
−
−
−
−
−
−
−
ns  
ns  
ns  
2.0  
4.5  
6.0  
Fig.10; note 2  
Fig.13  
REXT  
external timing  
resistor  
5
1
−
−
1000  
1000  
−
−
−
−
−
−
−
−
−
−
kΩ  
kΩ  
2.0  
5.0  
CEXT  
trem  
external timing  
capacitor  
50  
50  
pF  
pF  
2.0  
5.0  
Fig.13  
Fig.7  
no limits  
removal time  
MR to A, B  
120  
24  
20  
39  
14  
11  
−
−
−
150  
−
−
−
180  
36  
31  
−
−
−
ns  
ns  
ns  
2.0  
4.5  
6.0  
30  
26  
September 1993  
10  
1...78910111213...23

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