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74HCT3G04DP-Q100H

更新时间： 2024-02-20 00:07:48

品牌	Logo	应用领域
恩智浦 - NXP		PC 光电二极管逻辑集成电路
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15页	196K
描述
74HC(T)3G04-Q100 - Inverter TSSOP 8-Pin

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74HCT3G04DP-Q100H 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
零件包装代码：	TSSOP	包装说明：	3 MM, PLASTIC, SOT505-2, TSSOP-8
针数：	8	Reach Compliance Code：	compliant
风险等级：	5.78	Is Samacsys：	N
Base Number Matches：	1

74HCT3G04DP-Q100H 数据手册

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NXP Semiconductors

74HC3G04-Q100; 74HCT3G04-Q100

Inverter

Table 8.

Dynamic characteristics …continued

Voltages are referenced to GND (ground = 0 V); all typical values are measured at T_amb= 25 C; for test circuit, see Figure 7.

Symbol Parameter Conditions

25 C

40 C to +85 C 40 C to +125 C Unit

Min

Typ

Max

Min

Max

Min

Max

74HCT3G04-Q100

[1]

t_pd

propagation nA to nY; see Figure 6

delay

V_CC= 4.5 V

[2]

[3]

t_t

transition

time

V_CC= 4.5 V; see Figure 6

C_PD

power

V_I= GND to V_CC 1.5 V

dissipation

capacitance

[1] t_pdis the same as t_PLHand t_PHL

[2] t_tis the same as t_TLHand t_THL

[3] _PDis used to determine the dynamic power dissipation (P_Din W).

P_D= C_PD V_CC² f_i N + (C_L V_CC² f_o) where:

f_i= input frequency in MHz;

f_o= output frequency in MHz;

C_L= output load capacitance in pF;

V_CC= supply voltage in V;

N = number of inputs switching;

(C_L V_CC² f_o) = sum of outputs.

12. Waveforms

nA input

GND

PHL

PLH

90 %

nY output

10 %

TLH

THL

mna722

Measurement points are given in Table 9.

Logic levels: V_OLand V_OHare typical output voltage levels that occur with the output load.

Fig 6. The data input (nA) to output (nY) propagation delays

Table 9.

Type

Measurement points

Input

V_M

Output

V_M

74HC3G04-Q100

74HCT3G04-Q100

0.5  V_CC

1.3 V

0.5  V_CC

1.3 V

74HC_HCT3G04_Q100

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Product data sheet

Rev. 2 — 18 November 2013

7 of 15

1...4 5 678 9 10...15

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