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74HC4052BQ-Q100

更新时间： 2024-01-06 07:21:03

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恩智浦 - NXP		/
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26页	304K
描述
SGL ENDED MULTIPLEXER

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74HC4052BQ-Q100 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	HVQCCN,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.42
模拟集成电路 - 其他类型：	SINGLE-ENDED MULTIPLEXER	JESD-30 代码：	R-PQCC-N16
JESD-609代码：	e4	长度：	3.5 mm
湿度敏感等级：	1	信道数量：	4
功能数量：	1	端子数量：	16
标称断态隔离度：	50 dB	最大通态电阻 (Ron)：	270 Ω
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	HVQCCN
封装形状：	RECTANGULAR	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：	260	座面最大高度：	1 mm
最大供电电压 (Vsup)：	10 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
最长断开时间：	375 ns	最长接通时间：	490 ns
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	2.5 mm

74HC4052BQ-Q100 数据手册

74HC4052-Q100; 74HCT4052-Q100

NXP Semiconductors

Dual 4-channel analog multiplexer/demultiplexer

10. Static characteristics

Table 6.

R_ONresistance per switch for 74HC405-Q100 and 74HCT4052-Q100

V_I= V_IHor V_IL; for test circuit see Figure 9.

V_isis the input voltage at a nYn or nZ terminal, whichever is assigned as an input.

V_osis the output voltage at a nYn or nZ terminal, whichever is assigned as an output.

For 74HC4052-Q100: V_CC GND or V_CC V_EE= 2.0 V, 4.5 V, 6.0 V and 9.0 V.

For 74HCT4052-Q100: V_CC GND = 4.5 V and 5.5 V, V_CC V_EE= 2.0 V, 4.5 V, 6.0 V and 9.0 V.

Symbol Parameter

Conditions

Min

Typ

Max

Unit

T_amb= 40 C to +85 C^[1]

R_ON(peak)ON resistance (peak)

V_is= V_CCto V_EE

[2]

V_CC= 2.0 V; V_EE= 0 V; I_SW= 100 A

V_CC= 4.5 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 6.0 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 4.5 V; V_EE= 4.5 V; I_SW= 1000 A

V_is= V_EE



100

225

200

165

R_ON(rail)ON resistance (rail)

V_CC= 2.0 V; V_EE= 0 V; I_SW= 100 A

V_CC= 4.5 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 6.0 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 4.5 V; V_EE= 4.5 V; I_SW= 1000 A

V_is= V_CC

150



175

150

130

V_CC= 2.0 V; V_EE= 0 V; I_SW= 100 A

V_CC= 4.5 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 6.0 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 4.5 V; V_EE= 4.5 V; I_SW= 1000 A

V_is= V_CCto V_EE

150



200

175

150

R_ON

ON resistance mismatch

between channels

V_CC= 2.0 V; V_EE= 0 V



V_CC= 4.5 V; V_EE= 0 V

V_CC= 6.0 V; V_EE= 0 V

V_CC= 4.5 V; V_EE= 4.5 V

T_amb= 40 C to +125 C

R_ON(peak)ON resistance (peak)

V_is= V_CCto V_EE

[2]

V_CC= 2.0 V; V_EE= 0 V; I_SW= 100 A

V_CC= 4.5 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 6.0 V; V_EE= 0 V; I_SW= 1000 A

V_CC= 4.5 V; V_EE= 4.5 V; I_SW= 1000 A



270

240

195

74HC_HCT4052_Q100

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Product data sheet

Rev. 2 — 22 November 2012

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