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74AUP1G0832GS

更新时间： 2024-02-18 14:09:58

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安世 - NEXPERIA		光电二极管逻辑集成电路
页数	文件大小	规格书
16页	258K
描述
Low-power 3-input AND-OR gateProduction

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74AUP1G0832GS 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	VSON,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.64
系列：	AUP/ULP/V	JESD-30 代码：	S-PDSO-N6
JESD-609代码：	e3	长度：	1 mm
逻辑集成电路类型：	AND-OR GATE	湿度敏感等级：	1
功能数量：	1	输入次数：	3
端子数量：	6	最高工作温度：	125 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	VSON	封装形状：	SQUARE
封装形式：	SMALL OUTLINE, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	21.8 ns	认证状态：	Not Qualified
座面最大高度：	0.35 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	0.8 V	标称供电电压 (Vsup)：	1.1 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.35 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	1 mm	Base Number Matches：	1

Nexperia

74AUP1G0832

Low-power 3-input AND-OR gate

7. Functional description

Table 4. Function table

H = HIGH voltage level; L = LOW voltage level.

Input

Output

7.1. Logic configurations

Table 5. Function selection table

Logic function

Figure

2-input AND

see Fig. 2

2-input OR

see Fig. 3 and Fig. 4

see Fig. 5

3-input gate with the Boolean function: Y = (A × B) + C

001aad944

001aad945

Fig. 2. 2-input AND gate

Fig. 3. 2-input OR gate

001aad947

001aad946

Fig. 5. 3-input gate with the Boolean function:

Y = (A × B) + C

Fig. 4. 2-input OR gate

74AUP1G0832

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Product data sheet

Rev. 7 — 13 July 2023

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型号	品牌	描述	获取价格	数据表
74AUP1G0832GS,132	NXP	74AUP1G0832 - Low-power 3-input AND-OR gate	获取价格
74AUP1G0832GW	NXP	Low-power 3-input AND-OR gate	获取价格
74AUP1G0832GW	NEXPERIA	Low-power 3-input AND-OR gateProduction	获取价格
74AUP1G0832GW,125	NXP	74AUP1G0832 - Low-power 3-input AND-OR gate TSSOP 6-Pin	获取价格
74AUP1G08FW4-7	DIODES	SINGLE 2 INPUT POSITIVE AND GATE	获取价格
74AUP1G08FZ4-7	DIODES	SINGLE 2 INPUT POSITIVE AND GATE	获取价格