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Datasheet > 逻辑 > 总线驱动器/收发器> 74ABT823D
74ABT823D PDF预览

74ABT823D

更新时间： 2024-01-27 08:19:14
品牌 Logo 应用领域
恩智浦 - NXP 总线驱动器总线收发器触发器逻辑集成电路光电二极管信息通信管理
页数 文件大小 规格书
7页 80K
描述
9-bit D-type flip-flop with reset and enable 3-State

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74ABT823D 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：4.40 MM, PLASTIC, MO-153, SOT355-1, TSSOP-24
针数：24Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.82
Is Samacsys：N其他特性：WITH CLEAR AND CLOCK ENABLE
系列：ABTJESD-30 代码：R-PDSO-G24
JESD-609代码：e4长度：7.8 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大频率@ Nom-Sup：125000000 Hz最大I（ol）：0.064 A
湿度敏感等级：1位数：9
功能数量：1端口数量：2
端子数量：24最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP24,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：5 V最大电源电流（ICC）：34 mA
传播延迟（tpd）：6.8 ns认证状态：Not Qualified
座面最大高度：1.1 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：BICMOS温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30触发器类型：POSITIVE EDGE
宽度：4.4 mmBase Number Matches：1

74ABT823D 数据手册

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Philips Semiconductors  
Product specification  
9-bit D-type flip-flop with reset and enable  
(3-State)  
74ABT823  
LOGIC SYMBOL  
LOGIC SYMBOL (IEEE/IEC)  
1
EN  
11  
R
2
3
4
5
6
7
8
9
10  
14  
G1  
13  
1C2  
D0 D1 D2 D3 D4 D5 D6 D7 D8  
13  
14  
CP  
CE  
2
23  
22  
21  
20  
19  
18  
17  
16  
15  
2D  
3
11  
1
MR  
4
5
OE  
Q0 Q1 Q2 Q3 Q4 Q5 Q6 Q7 Q8  
6
7
23 22 21 20 19 18 17 16 15  
8
9
10  
SA00228  
SA00229  
FUNCTION TABLE  
INPUTS  
OUTPUTS  
OPERATING MODE  
OE  
L
MR  
L
CE  
X
CP  
X
↑
Dn  
X
h
Q0 – Q8  
L
H
Clear  
L
H
L
Load and read data  
L
H
L
↑
l
L
L
H
H
X
↑
X
X
NC  
Z
Hold  
H
X
X
High impedance  
H
h
=
=
High voltage level  
High voltage level one set-up time prior to the Low-to-High  
clock transition  
Low voltage level  
Low voltage level one set-up time prior to the Low-to-High  
clock transition  
NC  
X
Z
↑
↑
=
=
=
=
=
No change  
Don’t care  
High impedance “off” state  
Low to High clock transition  
Not a Low-to-High clock transition  
L
l
=
=
LOGIC DIAGRAM  
14  
CE  
D0  
D1  
D2  
D3  
D4  
D5  
D6  
D7  
D8  
10  
2
3
4
5
6
7
8
9
13  
CP  
CP  
Q
CP  
Q
CP  
Q
CP  
CP  
Q
CP  
Q
CP  
Q
CP  
Q
CP  
Q
D
D
D
R
D
D
D
D
D
R
D
R
R
R
RR  
Q
R
R
R
11  
MR  
OE  
1
23  
Q0  
22  
Q1  
21  
Q2  
20  
Q3  
19  
Q4  
18  
Q5  
17  
Q6  
16  
Q7  
15  
Q8  
SA00230  
2
1995 Sep 06  
1234567

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型号 品牌 描述 获取价格 数据表
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