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71V2558XS133BGG

更新时间: 2024-02-20 07:19:13
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艾迪悌 - IDT 时钟静态存储器内存集成电路
页数 文件大小 规格书
28页 567K
描述
ZBT SRAM, 256KX18, 4.2ns, CMOS, PBGA119, 22 X 14 MM, ROHS COMPLIANT, PLASTIC, MS-028AA, BGA-119

71V2558XS133BGG 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Obsolete零件包装代码:BGA
包装说明:22 X 14 MM, ROHS COMPLIANT, PLASTIC, MS-028AA, BGA-119针数:119
Reach Compliance Code:compliantECCN代码:3A991.B.2.A
HTS代码:8542.32.00.41风险等级:5.3
最长访问时间:4.2 ns其他特性:PIPELINED ARCHITECTURE
最大时钟频率 (fCLK):133 MHzI/O 类型:COMMON
JESD-30 代码:R-PBGA-B119JESD-609代码:e1
长度:22 mm内存密度:4718592 bit
内存集成电路类型:ZBT SRAM内存宽度:18
湿度敏感等级:3功能数量:1
端子数量:119字数:262144 words
字数代码:256000工作模式:SYNCHRONOUS
最高工作温度:70 °C最低工作温度:
组织:256KX18输出特性:3-STATE
封装主体材料:PLASTIC/EPOXY封装代码:BGA
封装等效代码:BGA119,7X17,50封装形状:RECTANGULAR
封装形式:GRID ARRAY并行/串行:PARALLEL
峰值回流温度(摄氏度):260电源:3.3 V
认证状态:Not Qualified座面最大高度:2.36 mm
最大待机电流:0.04 A最小待机电流:3.14 V
子类别:SRAMs最大压摆率:0.3 mA
最大供电电压 (Vsup):3.465 V最小供电电压 (Vsup):3.135 V
标称供电电压 (Vsup):3.3 V表面贴装:YES
技术:CMOS温度等级:COMMERCIAL
端子面层:Tin/Silver/Copper (Sn/Ag/Cu)端子形式:BALL
端子节距:1.27 mm端子位置:BOTTOM
处于峰值回流温度下的最长时间:30宽度:14 mm
Base Number Matches:1

71V2558XS133BGG 数据手册

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IDT71V2556, IDT71V2558, 128K x 36, 256K x 18, 3.3V Synchronous ZBT™ SRAMs  
with 2.5V I/O, Burst Counter, and Pipelined Outputs  
Commercial and Industrial Temperature Ranges  
RecommendedOperating  
TemperatureandSupplyVoltage  
Grade  
Temperature(1)  
0°C to +70°C  
-40°C to +85°C  
V
SS  
V
DD  
VDDQ  
Commercial  
Industrial  
0V  
0V  
3.3V±5%  
3.3V±5%  
2.5V±5%  
2.5V±5%  
4875 tbl 05  
NOTES:  
1. TA is the "instant on" case temperature.  
Pin Configuration — 128K x 36  
100 99 98 97 96 95 94 93 92 91 90 89 88 87 86 85 84 83 82 81  
1
80  
79  
78  
77  
I/OP3  
I/O16  
I/O17  
I/OP2  
I/O15  
I/O14  
2
3
4
VDDQ  
V
DDQ  
5
VSS  
76  
75  
74  
73  
VSS  
6
I/O18  
I/O19  
I/O20  
I/O21  
I/O13  
I/O12  
I/O11  
I/O10  
7
8
9
72  
71  
70  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
29  
30  
VSS  
V
V
SS  
VDDQ  
DDQ  
69  
68  
67  
66  
65  
64  
I/O22  
I/O9  
I/O8  
I/O23  
(1)  
VDD  
V
VDD  
SS  
(1)  
V
DD  
DD  
(1)  
V
VDD  
(3)  
VSS  
VSS/ZZ  
63  
62  
I/O24  
I/O25  
I/O7  
I/O6  
61  
60  
59  
VDDQ  
VDDQ  
VSS  
V
SS  
I/O26  
I/O27  
I/O28  
I/O29  
I/O  
I/O  
I/O  
I/O  
5
58  
57  
56  
55  
4
3
2
VSS  
V
V
SS  
54  
53  
VDDQ  
DDQ  
I/O30  
I/O31  
I/OP4  
I/O  
I/O  
I/OP1  
1
52  
51  
0
31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50  
,
4875 drw 02  
Top View  
TQFP  
NOTES:  
1. Pins 14, 16 and 66 do not have to be connected directly to VDD as long as the input voltage is VIH.  
2. Pins 83 and 84 are reserved for future 8M and 16M respectively.  
3. Pin 64 does not have to be connected directly to VSS as long as the input voltage is VIL; on the latest die revision this  
pin supports ZZ (sleep mode).  
6.42  
5

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71V2558XS133BQGI IDT ZBT SRAM, 256KX18, 4.2ns, CMOS, PBGA165, 15 X 13 MM, ROHS COMPLIANT, FBGA-165

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