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70V7319S200BF

更新时间: 2024-02-27 10:59:54
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艾迪悌 - IDT 静态存储器内存集成电路
页数 文件大小 规格书
22页 222K
描述
Dual-Port SRAM, 256KX18, 10ns, PBGA208, FBGA-208

70V7319S200BF 技术参数

是否无铅: 含铅是否Rohs认证: 不符合
生命周期:Active零件包装代码:BGA
包装说明:TFBGA,针数:208
Reach Compliance Code:compliantECCN代码:3A991.B.2.A
HTS代码:8542.32.00.41风险等级:5.8
最长访问时间:10 ns其他特性:FLOW-THROUGH OR PIPELINED ARCHITECTURE
JESD-30 代码:S-PBGA-B208JESD-609代码:e0
长度:15 mm内存密度:4718592 bit
内存集成电路类型:DUAL-PORT SRAM内存宽度:18
湿度敏感等级:3功能数量:1
端子数量:208字数:262144 words
字数代码:256000工作模式:SYNCHRONOUS
最高工作温度:70 °C最低工作温度:
组织:256KX18封装主体材料:PLASTIC/EPOXY
封装代码:TFBGA封装形状:SQUARE
封装形式:GRID ARRAY, THIN PROFILE, FINE PITCH并行/串行:PARALLEL
峰值回流温度(摄氏度):225认证状态:Not Qualified
座面最大高度:1.2 mm最大供电电压 (Vsup):3.45 V
最小供电电压 (Vsup):3.15 V标称供电电压 (Vsup):3.3 V
表面贴装:YES技术:CMOS
温度等级:COMMERCIAL端子面层:Tin/Lead (Sn/Pb)
端子形式:BALL端子节距:0.8 mm
端子位置:BOTTOM处于峰值回流温度下的最长时间:20
宽度:15 mmBase Number Matches:1

70V7319S200BF 数据手册

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IDT70V7319S  
High-Speed 256K x 18 Synchronous Bank-Switchable Dual-Port Static RAM  
Industrial and Commercial Temperature Ranges  
Pin Configuration(1,2,3,4) (con't.)  
70V7319BC  
BC-256(5)  
256-Pin BGA  
Top View(6)  
11/20/01  
A1  
A2  
A3  
A6  
A7  
A8  
A9  
A11  
A12  
A13  
A14  
A4  
A5  
A10  
A15  
A16  
NC  
TDI  
NC  
A
11L  
A
8L  
9L  
NC CE1L  
CNTEN  
L
A
5L  
A
2L  
A
0L  
BA5L BA2L  
OE  
L
NC  
NC  
B1  
B2  
B3  
B6  
B7  
B9  
CE0L  
B11  
B12  
B13  
B4  
B5  
B8  
B10  
B14  
B15  
B16  
NC  
NC TDO  
BA0L  
A
REPEAT  
L
A4L  
A
1L  
NC BA3L  
UB  
L
R/W  
L
VDD  
NC  
NC  
C1  
C5  
BA1L  
C6  
C2  
C3  
C4  
BA4L  
C7  
C8  
C9  
C10  
C11  
C12  
C13  
C16  
C14  
C15  
NC  
A10L  
I/O9L  
V
SS  
A
7L  
NC  
LB  
L
CLK  
L
ADS  
L
A6L  
A
3L  
I/O8L  
OPT  
L
NC  
D1  
D2  
D6  
DDQL  
D9  
DDQL  
D11  
DDQR  
D3  
D5  
D7  
DDQR  
D8  
DDQR  
D10  
D12  
D13  
D14  
D15  
D16  
D4  
NC I/O9R  
V
V
V
DDQL  
NC  
VDDQL  
V
V
V
V
DDQR  
V
DD  
NC  
NC I/O8R  
PL/FT  
L
E5  
E6  
E7  
E8  
E9  
E10  
E11  
E12  
E13  
E1  
E2  
E3  
E4  
E14  
E16  
E15  
V
DD  
VDD  
V
SS  
VSS  
VSS  
VSS  
V
DD  
VDD  
VDDQR  
I/O10R I/O10L NC  
V
DDQL  
NC  
I/O7R  
I/O7L  
F7  
F5  
F6  
G6  
H6  
F9  
F10  
F1  
F2  
F3  
F11  
F13  
F14  
F15  
F16  
F8  
F12  
F4  
V
SS  
I/O11L NC I/O11R  
V
DD  
V
SS  
V
SS  
VSS  
I/O6R  
VDDQR  
NC I/O6L  
V
SS  
V
DDQL  
V
SS  
VDD  
G1  
G5  
H5  
G2  
G4  
G8  
G9  
G3  
G14  
G15  
G16  
G7  
G10  
G12  
G13  
G11  
NC  
V
SS  
NC  
V
DDQR  
VSS  
V
SS  
V
SS  
I/O12L  
V
SS  
VSS  
VSS  
VDDQL I/O5L NC  
NC  
V
SS  
H11  
H12  
H16  
H13  
H7  
H8  
H9  
H10  
H14  
H15  
H3  
H4  
H1  
H2  
V
SS  
VSS  
I/O5R  
VDDQL  
V
SS  
VSS  
VSS  
VSS  
NC  
NC  
NC  
V
DDQR  
VSS  
VSS  
NC I/O12R  
J1  
J5  
J2  
J3  
J4  
J6  
J7  
J8  
J9  
J13  
J10  
J11  
J12  
J14  
J15  
J16  
I/O13L  
V
SS  
I/O14R I/O13R  
V
DDQL  
V
SS  
V
SS  
V
SS  
V
SS  
V
DDQR  
V
SS  
V
SS  
SS  
V
SS  
I/O4R  
I/O3R I/O4L  
K6  
K8  
K10  
K12  
K13  
K2  
K4  
K5  
L5  
K7  
K9  
K11  
K15  
K16  
K1  
K3  
K14  
VSS  
V
SS  
VSS  
VSS  
V
DDQR  
V
SS  
V
SS  
SS  
SS  
V
SS  
V
NC  
V
DDQL  
NC I/O3L  
NC  
I/O14L  
NC  
L7  
L8  
L11  
L12  
L13  
L6  
L9  
L10  
L3  
L4  
L15  
L16  
L1  
L2  
L14  
V
V
SS  
V
SS  
VDD  
V
DDQL  
I/O15R  
V
DDQR  
V
DD  
V
SS  
V
SS  
VSS  
NC I/O2R  
I/O15L NC  
I/O2L  
M5  
M6  
M7  
M8  
M9  
M10  
M11  
M12  
M13  
M1  
M2  
M3  
M4  
M16  
M14  
M15  
V
DD  
VDD  
V
V
SS  
V
SS  
VSS  
V
DD  
VDD  
V
DDQL  
I/O16R I/O16L NC  
V
DDQR  
NC  
I/O1R I/O1L  
N8  
N12  
N16  
N13  
N4  
N5  
N6  
N7  
DDQL  
N9  
N10  
N11  
N15  
N1  
N2  
N3  
N14  
V
DDQL  
VDDQL  
NC  
V
DD  
PL/FT  
R
V
DDQR  
V
DDQR  
V
VDDQR  
V
DDQR  
VDDQL  
I/O0R  
NC I/O17R NC  
NC  
P1  
P2  
P3  
P4  
P5  
P7  
P8  
P9  
P10  
P11  
P12  
P14  
P15  
P16  
P6  
P13  
NC I/O17L TMS BA4R BA1R  
A
7R  
NC  
LB  
R
CLK  
R
ADS  
R
A
6R  
NC  
NC I/O0L  
R16  
A
10R  
A
3R  
R5  
R6  
R7  
R8  
R9  
R10  
R11  
R1  
R2  
R3  
R4  
R12  
R13  
R14  
R15  
,
BA3R BA0R  
A9R  
UB  
R
CE0R R/W  
R
REPEAT  
R
NC  
NC  
NC TRST NC  
A4R  
A
1R OPT  
R
NC  
T2  
T3  
T1  
T4  
T5  
T8  
T9  
T15  
T16  
T6  
T7  
T10  
T11  
T12  
T13  
T14  
TCK  
NC  
NC  
BA5R BA2R  
NC CE1R  
NC  
NC  
A11R  
A8R  
OE  
R
CNTEN  
R
A5R  
A
2R  
A0R  
5629 drw 02d  
NOTES:  
1. All VDD pins must be connected to 3.3V power supply.  
,
2. All VDDQ pins must be connected to appropriate power supply: 3.3V if OPT pin for that port is set to VIH (3.3V), and 2.5V if OPT pin for that port is  
set to VIL (0V).  
3. All VSS pins must be connected to ground supply.  
4. Package body is approximately 17mm x 17mm x 1.4mm, with 1.0mm ball-pitch.  
5. This package code is used to reference the package diagram.  
6. This text does not indicate orientation of the actual part-marking.  
6.42  
3

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70V7319S200BFG IDT

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HIGH-SPEED 3.3V 256K x 18 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM
70V7319S200BFG8 IDT

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HIGH-SPEED 3.3V 256K x 18 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM
70V7319S200BFGI IDT

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HIGH-SPEED 3.3V 256K x 18 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM
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HIGH-SPEED 3.3V 256K x 18 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM
70V7319S200BFI IDT

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70V7319S200DD IDT

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Dual-Port SRAM, 256KX18, 10ns, CMOS, PQFP144, TQFP-144
70V7319S200DDI IDT

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Dual-Port SRAM, 256KX18, 10ns, PQFP144, TQFP-144
70V7319S2133BCG IDT

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Dual-Port SRAM, 256KX18, 4.2ns, CMOS, PBGA256, 17 X 17 MM, 1.4 MM HEIGHT, 1 MM PITCH, GREE
70V7319S2133BCGI IDT

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Dual-Port SRAM, 256KX18, 4.2ns, CMOS, PBGA256, 17 X 17 MM, 1.4 MM HEIGHT, 1 MM PITCH, GREE
70V7319S2133BFG IDT

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Dual-Port SRAM, 256KX18, 4.2ns, CMOS, PBGA208, 15 X 15 MM, 1.40MM HEIGHT, 0.80 MM PITCH, G