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7025L15GG

更新时间： 2024-02-27 01:56:56

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艾迪悌 - IDT		静态存储器内存集成电路
页数	文件大小	规格书
22页	204K
描述
Dual-Port SRAM

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7025L15GG 技术参数

生命周期：	Active	包装说明：	PGA,
Reach Compliance Code：	compliant	风险等级：	5.19
最长访问时间：	15 ns	JESD-30 代码：	S-CPGA-P84
内存密度：	131072 bit	内存集成电路类型：	DUAL-PORT SRAM
内存宽度：	16	功能数量：	1
端子数量：	84	字数：	8192 words
字数代码：	8000	工作模式：	ASYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	8KX16	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	PGA	封装形状：	SQUARE
封装形式：	GRID ARRAY	并行/串行：	PARALLEL
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	COMMERCIAL
端子形式：	PIN/PEG	端子位置：	PERPENDICULAR
Base Number Matches：	1

7025L15GG 数据手册

IDT7025S/L

High-Speed 8K x 16 Dual-Port Static RAM

Military, Industrial and Commercial Temperature Ranges

Data Retention Characteristics Over All Temperature Ranges

(L Version Only)

Symbol

Parameter

Test Condition

Min.

Typ.⁽¹⁾

Max.

Unit

___

CC for Data Retention

CC = 2V

2.0

___

ICCDR

Data Retention Current

µA

CE > VHC

IN > VHC or < VLC

MIL. & IND.

COM'L.

100

4000

___

100

1500

(3)

___

CDR

Chip Deselect to Data Retention Time

Operation Recovery Time

SEM > VHC

(3)

(2)

___

2683 tbl 10

NOTES:

1. TA = +25°C, VCC = 2V, and are not production tested.

2. tRC = Read Cycle Time

3. This parameter is guaranteed by device characterization, but is not production tested.

4. At Vcc < 2.0V input leakages are undefined.

Data Retention Waveform

DATA RETENTION MODE

VDR

≥

4.5V

VCC

tCDR

VDR

VIH

2683 drw 05

AC Test Conditions

Input Pulse Levels

GND to 3.0V

5ns Max.

1.5V

Input Rise/Fall Times

Input Timing Reference Levels

Output Reference Levels

Output Load

1.5V

Figures 1 and 2

2683 tbl 11

893Ω

DATAOUT

BUSY

INT

DATAOUT

30pF

347Ω

5pF*

347Ω

2683 drw 06

Figure 2. Output Test Load

(for t^LZ, tHZ, tWZ, tOW)

* including scope and jig.

Figure 1. AC Output Test Load

6.482

1...5 6 789 10 11...22

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