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5V49EE902NLGI

更新时间： 2024-01-23 09:33:34
品牌 Logo 应用领域
艾迪悌 - IDT 可编程只读存储器电动程控只读存储器电可擦编程只读存储器驱动逻辑集成电路
页数 文件大小 规格书
33页 372K
描述
EEPROM PROGRAMMABLE CLOCK GENERATOR

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5V49EE902NLGI 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：VFQFPN
包装说明：VFQFPN-32针数：32
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：3.52
Samacsys Description：VFQFP-N 5 X 5 NO LEAD系列：5V
输入调节：MUXJESD-30 代码：S-XQCC-N32
JESD-609代码：e3长度：5 mm
逻辑集成电路类型：PLL BASED CLOCK DRIVER湿度敏感等级：3
功能数量：1反相输出次数：
端子数量：32实输出次数：7
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.075 ns
座面最大高度：0.9 mm最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn) - annealed端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：5 mm
最小 fmax：500 MHz

5V49EE902NLGI 数据手册

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IDT5V49EE902  
EEPROM PROGRAMMABLE CLOCK GENERATOR  
CLOCK SYNTHESIZER  
Revision History  
Rev. Originator  
Date  
Description of Change  
A
B
C
R.Willner  
R.Willner  
R.Willner  
4/22/09 Advance Information.  
5/04/09 Identified VDDX (crystal oscillator power) and AVDD (analog power) on device.  
6/04/09 Add default configurations, pull-down resistor values on input pins.  
Released Datasheet from Advanced Information.  
D
R.Willner  
06/10/09 Updates: crystal load specs; “Output Duty Cycle” specs; addresses 0x07, 0x02 and 0xBF  
in “Programming Registers” table.  
E
F
G
H
J
R.Willner  
R.Willner  
R.Willner  
R.Willner  
R.Willner  
A. Tsui  
08/26/09 Updated 32-pin VFQFPN thermal data.  
10/05/09 Changed IP3[3:0] to IP3[4:0]; updated “Programming Registers Table”.  
12/09/09 Increased Max VCO frequency to 1300 MHz  
02/23/10 Updated Recommended Operation Conditions to include Vddx and AVdd parameters.  
04/22/11 Added 32QFN Landing Pattern diagram.  
K
L
07/07/11 Updated package dimension drawing  
R. Willner  
04/17/12 1. Change description for SDAT and SCLK pins.  
2. Add new footnotes to pin descriptions table  
3. Added section "Crystal Clock Selection"  
4. Added logic diagram and Truth table for "SD/OE Pin Function" section.  
5. Corrected register readback values for 0x52~0x54 and 0x7C~0x7F.  
6. Update to QFN package drawing - exposed thermal pad callout.  
M
A. Tsui  
06/04/12 1. Updated SD-OE pin description; from (Default is active HIGH) to (Default is active  
LOW)  
2. Updated “OUTn” column in Truth Table with “High-Z” specs and added footnote 2,  
“High-Z regardless of OEM bits”.  
3. Updated “SD-OE Pin Function” section to reflect that SP is “0”changed from active  
HIGH to active LOW, and SP is “1” changed from active LOW to active HIGH.  
N
P
Q
R.Willner  
R.Willner  
A.B.  
06/18/12 Added Min/Max spread values to "Spread Spectrum Generation Specifications" table;  
fMOD - Max. 120kHz; Down Spread - Min. -0.5%, Max. -4.0%; Center Spread - Min.  
0.25%, Max. 2.0%  
09/24/12 Change differential outputs from 5pF loads to 2pF loads so that they are consistent with  
the industry. Capacitive loads were also added to the test circuit diagrams for HCSL  
outputs. Slew Rate (t4) Output Load test conditions were also changed from 15pF to 5pF.  
07/10/15 Added the following note under AC Timing Electrical Characteristics table:  
“Not guaranteed until customer specific configuration is approved by IDT.”  
IDT® EEPROM PROGRAMMABLE CLOCK GENERATOR  
32  
IDT5V49EE902 REV Q 071015  
1...2930313233

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