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5T2010BBGI8

更新时间： 2024-01-30 08:34:54

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艾迪悌 - IDT		驱动逻辑集成电路
页数	文件大小	规格书
24页	201K
描述
PLL Based Clock Driver, 5T Series, 10 True Output(s), 0 Inverted Output(s), PBGA144, GREEN, PLASTIC, BGA-144

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5T2010BBGI8 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	BGA
包装说明：	BGA, BGA144,12X12,40	针数：	144
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.45	系列：	5T
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-PBGA-B144
JESD-609代码：	e1	长度：	13 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	最大I（ol）：	0.012 A
湿度敏感等级：	3	功能数量：	1
反相输出次数：		端子数量：	144
实输出次数：	10	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	BGA
封装等效代码：	BGA144,12X12,40	封装形状：	SQUARE
封装形式：	GRID ARRAY	峰值回流温度（摄氏度）：	260
电源：	2.5 V	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.1 ns	座面最大高度：	1.97 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	2.7 V
最小供电电压 (Vsup)：	2.3 V	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Tin/Silver/Copper (Sn/Ag/Cu)	端子形式：	BALL
端子节距：	1 mm	端子位置：	BOTTOM
处于峰值回流温度下的最长时间：	30	宽度：	13 mm
最小 fmax：	250 MHz	Base Number Matches：	1

5T2010BBGI8 数据手册

IDT5T2010

INDUSTRIALTEMPERATURERANGE

2.5VZERODELAYPLLCLOCKDRIVER TERACLOCK

2.5V ZERO DELAY PLL

CLOCK DRIVER TERACLOCK™

IDT5T2010

FEATURES:

DESCRIPTION:

• 2.5VDD

The IDT5T2010 is a 2.5V PLL clock driver intended for high perfor-

• 5 pairs of outputs

mancecomputinganddata-communicationsapplications. TheIDT5T2010

hastenoutputsinfivebanksoftwo,plusadedicateddifferentialfeedback.

The redundant input capability allows for a smooth change over to a

secondary clock source when the primary clock source is absent.

The feedbackbankallows divide-by-functionalityfrom1to12through

the use of the DS[1:0] inputs. This provides the user with frequency

multiplication1to12withoutusingdividedoutputsforfeedback. Eachoutput

bank also allows for a divide-by functionality of 2 or 4.

The IDT5T2010 features a user-selectable, single-ended or differential

inputtotensingle-endedoutputs. Theclockdriveralsoactsasatranslatorfrom

a differential HSTL, eHSTL, 1.8V/2.5V LVTTL, LVEPECL, or single-ended

1.8V/2.5V LVTTL input to HSTL, eHSTL, or 1.8V/2.5V LVTTL outputs.

Selectableinterfaceiscontrolledby3-levelinputsignalsthatmaybehard-wired

to appropriate high-mid-low levels. The outputs can be synchronously

enabled/disabled.

• Low skew: 50ps same pair, 100ps all outputs

• Selectable positive or negative edge synchronization

• Tolerant of spread spectrum input clock

• Synchronous output enable

• Selectable inputs

• Input frequency: 4.17MHz to 250MHz

• Output frequency: 12.5MHz to 250MHz

• 1.8V / 2.5V LVTTL: up to 250MHz

• HSTL / eHSTL: up to 250MHz

• Hot insertable and over-voltage tolerant inputs

• 3-level inputs for selectable interface

• 3-level inputs for feedback divide selection with multiply ratios

of(1-6, 8, 10, 12)

• Selectable HSTL, eHSTL, 1.8V/2.5V LVTTL, or LVEPECL input

interface

• Selectable differential or single-ended inputs and ten single-

ended outputs

Furthermore,whenPEisheldhigh,alltheoutputsaresynchronizedwith

thepositiveedgeoftheREFclockinput.WhenPEisheldlow,alltheoutputs

are synchronized with the negative edge of REF.

• PLL bypass for DC testing

• External differential feedback, internal loop filter

• Low Jitter: <75ps cycle-to-cycle

• Power-down mode

• Lock indicator

• Available in BGA and VFQFPN packages

TxS

FUNCTIONALBLOCKDIAGRAM

1sOE

1Q0

OMODE

Divide

Select

1Q1

1F2:1

2sOE

2Q0

FS LOCK

Divide

Select

PLL_EN

2Q1

2F2:1

FB/

V^REF2

3sOE

3Q0

3Q1

DS1:0

Divide

Select

PLL

REF0

3F2:1

REF0/

V^REF0

4sOE

5sOE

4Q0

4Q1

Divide

Select

RxS

REF¹

4F2:1

REF1/

V^REF1

REF_SEL

Divide

Select

5Q0

5Q1

5F2:1

QFB

Divide

Select

TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.

FBF2:1

INDUSTRIAL TEMPERATURE RANGE

MARCH 2006

2006 Integrated Device Technology, Inc.

DSC 5981/29

12 3 4 5 6 7...24

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型号	品牌	获取价格	描述	数据表
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5T2010NLI8	IDT	获取价格	Low Skew Clock Driver, PQCC68
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5T2110NLGI8	IDT	获取价格	PLL Based Clock Driver, 5T Series, 5 True Output(s), 0 Inverted Output(s), PQCC68, GREEN,
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