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5962-9321901QSA

更新时间： 2024-01-15 20:43:03
品牌 Logo 应用领域
德州仪器 - TI 总线驱动器总线收发器锁存器逻辑集成电路输出元件信息通信管理
页数 文件大小 规格书
20页 760K
描述
OCTAL TRANSPARENT D-TYPE LATCHES WITH 3-STATE OUTPUTS

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5962-9321901QSA 技术参数

生命周期：Active零件包装代码：DFP
包装说明：DFP,针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.78其他特性：BROADSIDE VERSION OF 373
系列：ABTJESD-30 代码：R-GDFP-F20
逻辑集成电路类型：BUS DRIVER位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DFP封装形状：RECTANGULAR
封装形式：FLATPACK传播延迟（tpd）：7.5 ns
认证状态：Qualified筛选级别：MIL-PRF-38535 Class Q
座面最大高度：2.286 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：BICMOS
温度等级：MILITARY端子形式：FLAT
端子节距：1.27 mm端子位置：DUAL
宽度：6.731 mmBase Number Matches：1

5962-9321901QSA 数据手册

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SCBS190F − JANUARY 1991 − REVISED SEPTEMBER 2003  
description/ordering information (continued)  
A buffered output-enable (OE) input can be used to place the eight outputs in either a normal logic state (high  
or low logic levels) or the high-impedance state. In the high-impedance state, the outputs neither load nor drive  
the bus lines significantly. The high-impedance state and increased drive provide the capability to drive bus  
lines without need for interface or pullup components.  
OE does not affect the internal operations of the latches. Old data can be retained or new data can be entered  
while the outputs are in the high-impedance state.  
To ensure the high-impedance state during power up or power down, OE should be tied to V  
resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.  
through a pullup  
CC  
This device is fully specified for partial-power-down applications using I . The I circuitry disables the outputs,  
off  
off  
preventing damaging current backflow through the device when it is powered down.  
SN74ABT573A . . . GQN OR ZQN PACKAGE  
(TOP VIEW)  
terminal assignments  
1
2
3
4
1
1D  
2
3
4
A
B
C
D
E
A
B
C
D
E
OE  
3Q  
4D  
7Q  
8D  
V
1Q  
2Q  
4Q  
6Q  
8Q  
CC  
3D  
2D  
5Q  
6D  
LE  
5D  
7D  
GND  
FUNCTION TABLE  
(each latch)  
INPUTS  
OUTPUT  
Q
OE  
L
LE  
H
H
L
D
H
L
H
L
L
L
X
X
Q
0
H
X
Z
logic diagram (positive logic)  
1
OE  
11  
LE  
C1  
1D  
19  
1Q  
2
1D  
To Seven Other Channels  
Pin numbers shown are for the DB, DW, FK, J, N, NS, PW, RGY, and W packages.  
2
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...20

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