5962-89841143X

更新时间： 2024-02-28 00:40:21

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爱特美尔 - ATMEL		可编程逻辑器件输入元件异步传输模式 ATM 时钟
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描述
High-performance Electrically Erasable Programmable Logic Device

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5962-89841143X 技术参数

生命周期：	Obsolete	零件包装代码：	QLCC
包装说明：	QCCN,	针数：	28
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.2.C
HTS代码：	8542.39.00.01	风险等级：	5.82
Is Samacsys：	N	最大时钟频率：	31.2 MHz
JESD-30 代码：	S-CQCC-N28	专用输入次数：	11
I/O 线路数量：	10	端子数量：	28
最高工作温度：	125 °C	最低工作温度：	-55 °C
组织：	11 DEDICATED INPUTS, 10 I/O	输出函数：	MACROCELL
封装主体材料：	CERAMIC, METAL-SEALED COFIRED	封装代码：	QCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER
可编程逻辑类型：	FLASH PLD	传播延迟：	20 ns
认证状态：	Not Qualified	筛选级别：	MIL-STD-883
最大供电电压：	5.5 V	最小供电电压：	4.5 V
标称供电电压：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子形式：	NO LEAD	端子位置：	QUAD
Base Number Matches：	1

Atmel ATF22V10B

Input Test Waveforms and Measurement Levels

t_R, t_F< 3ns

Output Test Loads

Commercial

Military

* All except -7 which is R2 = 300

Pin Capacitance

f = 1MHz, T = 25°C⁽¹⁾

Typ

Max

Units

Conditions

C_IN

V_IN= 0V

C_OUT

V_OUT= 0V

Note:

1. Typical values for nominal supply voltage. This parameter is only sampled and is not 100% tested

Power-up Reset

The registers in the Atmel^®ATF22V10B are designed to reset during power-up. At a point delayed slightly from

V_CCcrossing V_RST, all registers will be reset to the low state. The output state will depend on the polarity of the out-

put buffer.

This feature is critical for state machine initialization. However, due to the asynchronous nature of reset and the

uncertainty of how V_CCactually rises in the system, the following conditions are required:

1. The V_CCrise must be monotonic

2. After reset occurs, all input and feedback setup times must be met before driving the clock pin high

3. The clock must remain stable during t_PR

0250M–PLD–7/10

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型号	品牌	描述	获取价格	数据表
5962-8984114LA	ATMEL	Highperformance EE PLD	获取价格
5962-89841153A	ATMEL	High-performance Electrically Erasable Programmable Logic Device	获取价格
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5962-8984201GX	ETC	Analog Comparator	获取价格