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Datasheet > 逻辑 > 总线驱动器/收发器> 54ABT373E-QML
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54ABT373E-QML

更新时间： 2024-01-24 19:36:35
品牌 Logo 应用领域
美国国家半导体 - NSC 锁存器
页数 文件大小 规格书
14页 360K
描述
Octal Transparent Latch with TRI-STATE Outputs

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54ABT373E-QML 技术参数

是否Rohs认证： 不符合生命周期：Transferred
包装说明：DFP, FL20,.3Reach Compliance Code：unknown
风险等级：5.81JESD-30 代码：R-XDFP-F20
JESD-609代码：e0负载电容（CL）：50 pF
逻辑集成电路类型：D LATCH最大I（ol）：0.048 A
位数：8功能数量：1
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
封装主体材料：CERAMIC封装代码：DFP
封装等效代码：FL20,.3封装形状：RECTANGULAR
封装形式：FLATPACK电源：5 V
Prop。Delay @ Nom-Sup：7 ns认证状态：Not Qualified
筛选级别：38535Q/M;38534H;883B子类别：FF/Latches
标称供电电压 (Vsup)：5 V表面贴装：YES
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：FLAT端子节距：1.27 mm
端子位置：DUALBase Number Matches：1

54ABT373E-QML 数据手册

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Functional Description  
Truth Table  
The ’ABT373 contains eight D-type latches with TRI-STATE  
output buffers. When the Latch Enable (LE) input is HIGH,  
data on the Dn inputs enters the latches. In this condition the  
latches are transparent, i.e., a latch output will change state  
each time its D input changes. When LE is LOW, the latches  
store the information that was present on the D inputs a  
setup time preceding the HIGH-to-LOW transition of LE. The  
TRI-STATE buffers are controlled by the Output Enable (OE)  
input. When OE is LOW, the buffers are in the bi-state mode.  
When OE is HIGH the buffers are in the high impedance  
mode but this does not interfere with entering new data into  
the latches.  
Inputs  
Output  
LE  
H
H
L
OE  
L
Dn  
H
L
On  
H
L
L
L
X
On (no change)  
Z
X
H
X
=
=
=
=
H
L
X
Z
HIGH Voltage Level  
LOW Voltage Level  
Immaterial  
High Impedance State  
Logic Diagram  
DS100206-3  
Please note that this diagram is provided only for the understanding of logic operations and should not be used to estimate propagation delays.  
www.national.com  
2
1234567...14

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型号 品牌 描述 获取价格 数据表
54ABT373J/883 ETC 8-Bit D-Type Latch

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