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54ABT16373W-QML

更新时间： 2024-01-29 15:15:53
品牌 Logo 应用领域
美国国家半导体 - NSC 锁存器逻辑集成电路信息通信管理驱动
页数 文件大小 规格书
6页 120K
描述
16-Bit Transparent Latch with TRI-STATE Outputs

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54ABT16373W-QML 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：DFP, FL48,.4,25Reach Compliance Code：unknown
ECCN代码：3A001.A.2.CHTS代码：8542.39.00.01
风险等级：5.58系列：ABT
JESD-30 代码：R-GDFP-F48JESD-609代码：e0
长度：15.748 mm逻辑集成电路类型：BUS DRIVER
位数：8功能数量：2
端口数量：2端子数量：48
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DFP
封装等效代码：FL48,.4,25封装形状：RECTANGULAR
封装形式：FLATPACK峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V最大电源电流（ICC）：85 mA
Prop。Delay @ Nom-Sup：6.5 ns传播延迟（tpd）：7 ns
认证状态：Not Qualified筛选级别：MIL-PRF-38535
座面最大高度：2.54 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：BICMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：FLAT
端子节距：0.64 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：9.65 mm
Base Number Matches：1

54ABT16373W-QML 数据手册

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Functional Description  
Truth Tables  
The ABT16373 contains sixteen D-type latches with  
TRI-STATE standard outputs. The device is byte controlled  
with each byte functioning identically, but independent of the  
other. Control pins can be shorted together to obtain full  
16-bit operation. The following description applies to each  
byte. When the Latch Enable (LEn) input is HIGH, data on  
the Dn enters the latches. In this condition the latches are  
transparent, i.e., a latch output will change states each time  
its D input changes. When LEn is LOW, the latches store in-  
formation that was present on the D inputs a setup time pre-  
ceding the HIGH-to-LOW transition of LEn. The TRI-STATE  
standard outputs are controlled by the Output Enable (OEn)  
input. When OEn is LOW, the standard outputs are in the  
2-state mode. When OEn is HIGH, the standard outputs are  
in the high impedance mode but this does not interfere with  
entering new data into the latches.  
Inputs  
Outputs  
LE1  
X
OE1  
H
D0–D7  
O0–O7  
X
L
Z
H
L
L
H
H
L
H
X
L
L
(Previous)  
Inputs  
Outputs  
LE2  
X
OE2  
H
D8–D15  
O8–O15  
X
L
Z
H
L
L
H
H
L
H
X
L
L
(Previous)  
=
=
=
=
H
L
X
Z
High Voltage Level  
Low Voltage Level  
Immaterial  
High Impedance  
=
Previous previous output prior to HIGH to LOW transition of LE  
Logic Diagrams  
DS100201-3  
DS100201-4  
www.national.com  
2
123456

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