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2EDN8524FXTMA1

更新时间： 2024-01-10 09:54:23

品牌	Logo	应用领域
英飞凌 - INFINEON		驱动光电二极管接口集成电路
页数	文件大小	规格书
31页	911K
描述
Buffer/Inverter Based Peripheral Driver, PDSO8, DSO-8

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技术参数
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2EDN8524FXTMA1 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	包装说明：	SOP,
Reach Compliance Code：	compliant	风险等级：	1.69
内置保护：	UNDER VOLTAGE	接口集成电路类型：	BUFFER OR INVERTER BASED PERIPHERAL DRIVER
JESD-30 代码：	R-PDSO-G8	长度：	4.93 mm
湿度敏感等级：	1	功能数量：	1
端子数量：	8	输出电流流向：	SOURCE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	NOT SPECIFIED	座面最大高度：	1.73 mm
最大供电电压：	20 V	最小供电电压：	4.5 V
标称供电电压：	12 V	表面贴装：	YES
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
断开时间：	0.023 µs	接通时间：	0.023 µs
宽度：	3.94 mm	Base Number Matches：	1

2EDN8524FXTMA1 数据手册

EiceDRIVER™

2EDN752x / 2EDN852x

Pin Configuration and Description

The pin configuration for all input versions of 2EDN7524R, 2EDN7523R, 2EDN8524R and 2EDN8523R in the PG-

TSSOP-8-1 package is shown in Figure 2. Drawings can be viewed in Chapter 8 (PG-TSSOP-8-1).

ENA

INA

ENB

OUTA

VDD

Exposed

Pad

GND

INB

OUTB

Figure 2

Table 4

Pin Configuration PG-TSSOP-8-1, Top View

Pin Configuration 2EDN7524R, 2EDN7523R, 2EDN8524R and 2EDN8523R in the PG-TSSOP-8-1

Package

Pin Symbol Description

ENA

Enable input channel A

Logic input; if ENA is high or left open, OUTA is controlled by INA; ENA low causes OUTA low

INA

Input signal channel A

Logic input, controlling OUTA (non-inverting)

GND

INB

Ground¹⁾

Input signal channel B

Logic input, controlling OUTB (non-inverting)

OUTB

VDD

Driver output channel B

Low-impedance output with source and sink capability

Positive supply voltage

Operating range 4.5 V/8.6V to 20 V

OUTA

ENB

Driver output channel A

Low-impedance output with source and sink capability

Enable input channel B

Logic Input; if ENB is high or left open, OUTB is controlled by INB; ENB low causes OUTB low

1) Exposed Pad sink of PG-TSSOP-8-1 packages has to be connected to GND pin.

Data Sheet

Rev.2.5

2018-04-20

1...4 5 678 9 10...31

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