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29109BRA

更新时间： 2024-01-30 23:05:00

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英特矽尔 - INTERSIL		内存集成电路静态存储器
页数	文件大小	规格书
7页	45K
描述
16K x 1 Asynchronous CMOS Static RAM

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技术参数
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29109BRA 技术参数

生命周期：	Transferred	零件包装代码：	DIP
包装说明：	,	针数：	20
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.2.C
HTS代码：	8542.32.00.41	风险等级：	5.72
最长访问时间：	70 ns	JESD-30 代码：	R-GDIP-T20
内存密度：	16384 bit	内存集成电路类型：	STANDARD SRAM
内存宽度：	1	功能数量：	1
端子数量：	20	字数：	16384 words
字数代码：	16000	工作模式：	ASYNCHRONOUS
最高工作温度：	125 °C	最低工作温度：	-55 °C
组织：	16KX1	封装主体材料：	CERAMIC, GLASS-SEALED
封装形状：	RECTANGULAR	封装形式：	IN-LINE
并行/串行：	SERIAL	认证状态：	Not Qualified
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子形式：	THROUGH-HOLE	端子位置：	DUAL

29109BRA 数据手册

HM-65262

Timing Waveforms

(3) TELQV

(7) TEHQZ

(4) TELQX

(5) TEHQX

NOTE:

1. W is high for entire cycle and D is ignored. Address is stable by the time E goes low and remains valid until E goes high.

FIGURE 1. READ CYCLE 1: CONTROLLED BY E

(1) TAVAX

(2) TAVQV

(4) TELQX

(7) TEHQZ

(6) TAXQX

NOTE:

1. W is high for the entire cycle and D is ignored. E is stable prior to A becoming valid and after A becomes invalid.

FIGURE 2. READ CYCLE 2: CONTROLLED BY ADDRESS

(8) TAVAX

(12) TWHAX

(17) TAVWH

(9) TELWH

(11)

TAVWL

(7) TEHQZ

(10) TWLWH

(13) TDVWH

(14) TWHDX

(16) TWHQX

(15) TWLQZ

(4)

TELQX

NOTE:

1. In this mode, E rises after W. The address must remain stable whenever both E and W are low.

FIGURE 3. WRITE CYCLE 1: CONTROLLED BY W (LATE WRITE)

6-5

1 2 3 456 7

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