23S09E-1HPGG

更新时间： 2024-01-23 02:43:36

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艾迪悌 - IDT		时钟
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8页	69K
描述
3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE

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23S09E-1HPGG 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
Reach Compliance Code：	not_compliant	风险等级：	5.92
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e0
最大I（ol）：	0.012 A	湿度敏感等级：	1
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP16,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
电源：	3.3 V	认证状态：	Not Qualified
子类别：	Clock Drivers	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	DUAL
Base Number Matches：	1

23S09E-1HPGG 数据手册

IDT23S09E

3.3VZERODELAYCLOCKBUFFER

COMMERCIALANDINDUSTRIALTEMPERATURERANGES

FUNCTIONTABLE⁽¹⁾

CLKA

Tri-State

Driven

CLKB

Tri-State

Driven

CLKOUT⁽²⁾

Driven

Output Source

PLL Shut Down

PLL

REF

Driven

PLL

NOTES:

1. H = HIGH Voltage Level.

L = LOW Voltage Level

2. This output is driven and has an internal feedback for the PLL. The load on this ouput can be adjusted to change the skew between the REF and the output.

DCELECTRICALCHARACTERISTICS-COMMERCIAL

Symbol

VIL

Parameter

Conditions

Min.

—

Max.

0.8

—

Unit

InputLOWVoltageLevel

Input HIGH Voltage Level

InputLOWCurrent

Input HIGH Current

OutputLOWVoltage

VIH

IIL

VIN = 0V

—

µA

IIH

VIN = VDD

100

0.4

VOL

StandardDrive

High Drive

StandardDrive

High Drive

IOL = 8mA

IOL = 12mA (-1H)

IOH = -8mA

VOH

Output HIGH Voltage

2.4

—

IOH = -12mA (-1H)

IDD_PD

IDD

Power Down Current

SupplyCurrent

REF = 0MHz (S2 = S1 = H)

Unloaded Outputs at 66.66MHz, SEL inputs at VDD or GND

—

µA

OPERATINGCONDITIONS-COMMERCIAL

Symbol

Parameter

Min.

Max.

3.6

Unit

VDD

SupplyVoltage

OperatingTemperature(AmbientTemperature)

Load Capacitance < 100MHz

°C

—

Load Capacitance 100MHz - 200MHz

InputCapacitance

CIN

SWITCHINGCHARACTERISTICS(23S09E-1)-COMMERCIAL^(1,2)

Symbol

Parameter

Conditions

Min.

Typ.

—

Max. Unit

OutputFrequency

10pFLoad

30pFLoad

—

200

100

MHz

Duty Cycle = t2 ÷ t1

RiseTime

Measured at 1.4V, FOUT = 66.66MHz

Measured between 0.8V and 2V

Alloutputsequallyloaded

2.5

250

350

8.7

700

200

FallTime

OutputtoOutputSkew

Delay, REF Rising Edge to CLKOUT Rising Edge⁽²⁾MeasuredatVDD/2

Delay, REF Rising Edge to CLKOUT Rising Edge⁽²⁾Measured at VDD/2 in PLL bypass mode (IDT23S09E only)

t6A

t6B

Device-to-Device Skew

Cycle-to-Cycle Jitter

Measured at VDD/2 on the CLKOUT pins of devices

Measuredat66.66MHz,loadedoutputs

—

tLOCK PLLLockTime

Stable power supply, valid clock presented on REF pin

—

NOTES:

1. REF Input has a threshold voltage of VDD/2.

2. All parameters specified with loaded outputs.

1 234 5 6 7 8

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