1514-3.5Y

更新时间： 2024-02-03 14:44:11

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DATADELAY		延迟线逻辑集成电路
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2页	29K
描述
FIXED SIP DELAY LINE TD/TR = 5

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1514-3.5Y 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SIP
包装说明：	SIP,	针数：	4
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.62	其他特性：	MEETS MIL-D-23859C; DIELECTRIC STRENGTH 50VDC; MAX DISTORTION 10%
系列：	1514	JESD-30 代码：	R-PSIP-T4
长度：	20.574 mm	逻辑集成电路类型：	PASSIVE DELAY LINE
功能数量：	1	抽头/阶步数：	1
端子数量：	4	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出阻抗标称值（Z0）：	75 Ω
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SIP	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	NOT SPECIFIED
可编程延迟线：	NO	认证状态：	Not Qualified
座面最大高度：	7.112 mm	表面贴装：	NO
技术：	HYBRID	温度等级：	MILITARY
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	SINGLE	处于峰值回流温度下的最长时间：	NOT SPECIFIED
总延迟标称（td）：	3.5 ns	宽度：	5.334 mm
Base Number Matches：	1

1514-3.5Y 数据手册

1514

.210

MAX.

.810 MAX.

.020

TYP.

.280

MAX.

.100

MIN.

.100

TYP.

.020 TYP.

.600 TYP.

.010

TYP.

Package Dimensions

PASSIVE DELAY LINE TEST SPECIFICATIONS

TEST CONDITIONS

INPUT:

Ambient Temperature:

Input Pulse:

OUTPUT:

25^oC ± 3^oC

High = 3.0V typical

Low = 0.0V typical

50W Max.

3.0 ns Max. (measured

at 10% and 90% levels)

R_load

C_load

10MW

10pf

Threshold: 50% (Rising & Falling)

Source Impedance:

Rise/Fall Time:

Pulse Width (TD <= 75ns): PW_IN= 100ns

Period (TD <= 75ns): PER_IN= 1000ns

Pulse Width (TD > 75ns): PW_IN= 2 x T_D

Period (TD > 75ns): PER_IN= 10 x T_D

NOTE: The above conditions are for test only and do not in any way restrict the operation of the device.

PER_IN

PW_IN

T_RISE

T_FALL

INPUT

SIGNAL

V_IH

90%

50%

10%

90%

50%

10%

V_IL

T_RISE

T_FALL

T_RISE

T_FALL

OUTPUT

SIGNAL

V_OH

90%

50%

10%

90%

50%

10%

V_OL

Timing Diagram For Testing

R_IN

OUT

DEVICE UNDER

TEST (DUT)

OSCILLOSCOPE

PULSE

GENERATOR

TRIG

R_OUT

50 W

R_IN= R_OUT= Z_LINE

Test Setup

Doc #97023

2/5/97

DATA DELAY DEVICES, INC.

Tel: 973-773-2299 Fax: 973-773-9672 http://www.datadelay.com

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