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11257-812

更新时间： 2024-01-10 03:28:53
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19页 384K
描述
LOW-SKEW CLOCK FANOUT BUFFER ICs

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11257-812 技术参数

生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP,针数：28
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.66Is Samacsys：N
输入调节：STANDARDJESD-30 代码：R-PDSO-G28
长度：17.9 mm逻辑集成电路类型：LOW SKEW CLOCK DRIVER
功能数量：1反相输出次数：
端子数量：28实输出次数：10
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE传播延迟（tpd）：5 ns
认证状态：Not Qualified座面最大高度：2.65 mm
最大供电电压 (Vsup)：3.465 V最小供电电压 (Vsup)：3.135 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
温度等级：COMMERCIAL端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：7.5 mmBase Number Matches：1

11257-812 数据手册

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ꢀꢁꢂꢃꢄꢅꢀꢆꢇꢁꢄꢅꢃꢈꢉꢊꢉꢋꢂꢁꢉXꢇꢄꢆꢅT  
April 1999  
Table 1: Pin Descriptions  
Key: AI = Analog Input; AO = Analog Output; DI = Digital Input; DIU = Input with Internal Pull-Up; DID = Input with Internal Pull-Down; DIO = Digital Input/Output; DI-3 = Three-Level Digital Input,  
DO = Digital Output; P = Power/Ground; # = Active Low pin  
PIN (FS6050) PIN (FS6051) PIN (FS6053) PIN (FS6054)  
TYPE  
NAME  
DESCRIPTION  
11  
25  
24  
4
9
15  
14  
2
9
15  
14  
2
9
15  
14  
2
DI  
DIU  
DIUO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DIU  
CLK_IN  
SCL  
Clock input for SDRAM clock outputs  
Serial clock input  
SDA  
Serial data input/output  
SDRAM_0  
SDRAM_1  
SDRAM_2  
SDRAM_3  
SDRAM_4  
SDRAM_5  
SDRAM_6  
SDRAM_7  
SDRAM_8  
SDRAM_9  
SDRAM_10  
SDRAM_11  
SDRAM_12  
SDRAM_13  
SDRAM_14  
SDRAM_15  
SDRAM_16  
SDRAM_17  
OE  
5
3
3
3
8
6
6
6
9
7
7
7
SDRAM clock outputs (Byte 0)  
13  
14  
17  
18  
31  
32  
35  
36  
40  
41  
44  
45  
21  
28  
38  
-
-
-
-
-
-
-
10  
11  
18  
19  
-
10  
11  
18  
19  
-
-
-
-
-
-
-
-
SDRAM clock outputs (Byte 1)  
22  
23  
26  
27  
11  
18  
20  
22  
23  
26  
27  
12  
-
22  
23  
26  
27  
12  
17  
20  
SDRAM feedback clock outputs (Byte 2)  
-
Output enable tristates all clock outputs when low  
3, 7, 12, 16,  
20, 29, 33, 37,  
42, 46  
1, 5, 10, 19,  
24, 28  
1, 5, 20, 24,  
28  
1, 5, 24, 28  
13  
P
P
P
VDD  
VDD_I2C  
VSS  
3.3V ± 5% power supply for SDRAM clock buffers  
3.3V ± 5% power supply for serial communications  
Ground for SDRAM clock buffers  
23  
13  
13  
6, 10, 15, 19,  
22, 27, 30, 34,  
39, 43  
4, 8, 12, 17,  
21, 25  
4, 8, 17, 21,  
25  
4, 8, 21, 25  
26  
16  
-
16  
-
16  
-
P
-
VSS_I2C  
Ground for serial communications  
Reserved  
1, 2, 47, 48  
(reserved)  
Figure 4: Pin Configuration (FS6053)  
Figure 5: Pin Configuration (FS6054)  
FS6054  
FS6053  
4.5.99  
2
,62ꢀꢁꢁꢂ  
1234567...19

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