TMS320F2800137, TMS320F2800135, TMS320F2800132
ZHCSR52A –OCTOBER 2022 –REVISED MARCH 2023
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修订历史记录
Changes from OCTOBER 20, 2022 to MARCH 13, 2023 (from Revision * (October 2022) to
Revision A (March 2023))
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• 通篇：本文档中的信息和数据现在是“量产数据”............................................................................................ 1
• 通篇：CMPSS_LITE：将“8 位有效基准DAC”更改为“9.5 位有效基准DAC”............................................1
• 特性一节：添加了“实时处理”组标题并更新了组。在“实时处理”下添加了对展示C2000™ 控制MCU 优
化信号链的实时基准测试应用手册的引用。在“系统外设”下将“模拟引脚上有21 个数字输入（11 个与
GPIO 共享）”更改为“在模拟引脚上提供 10 路数字输入”............................................................................ 1
• 器件信息 表：添加了“内部稳压器”列............................................................................................................. 2
• 器件比较表：添加了“内部3.3V 至1.2V 稳压器(VREG)”行。添加了VREGENZ 支持行和“具有
VREGENZ 的64 PM”封装行。........................................................................................................................ 8
• 引脚图一节：将图标题从“具有VREGENZ 的64 引脚PM Low-Profile Quad Flatpack（顶视图）”更改为
“F2800135V 上具有VREGENZ 的64 引脚PM Low-Profile Quad Flatpack（顶视图）”............................ 10
• 绝对最大额定值表：添加了“VDD”行........................................................................................................... 42
• 建议工作条件表：添加了“器件电源电压，VDD”行......................................................................................42
• 电气特性表：更新了ROH 和ROL 的最小值、典型值和最大值。添加了RPULLDOWN 和RPULLUP 行。更新了
“VREG 和BOR”部分，并添加了脚注以引用电源管理模块(PMM) 一节...................................................... 42
• ESD 等级表：添加了转角引脚.........................................................................................................................42
• 系统电流消耗- 启用VREG - 内部电源表：更新了表和脚注............................................................................44
• 系统电流消耗- 禁用VREG - 外部电源表：添加了此表...................................................................................44
• 每个禁用外设的典型电流降低表：为具有多个实例的外设添加了限定符。添加了“EPG”行。删除了
“SYSCLK=10MHz（PLL 旁路）”行..............................................................................................................49
• PMM 方框图：使用更正后的RISE DELAY 方框更新了图表............................................................................ 53
• VDD 去耦一节：添加了有关在外部VREG 模式下使用的实际去耦电容量的段落............................................55
• 电源引脚联动一节：添加了有关外部VREG 模式下的VDD 引脚的段落.........................................................56
• 电源时序摘要和违规影响一节：添加了外部VREG 序列摘要表..................................................................... 59
• 电源压摆率一节：添加了有关外部VREG 模式下的VDD 最小压摆率要求的段落和相关注释.........................59
• 电源管理模块运行条件表：添加了“外部VREG”一节。更新了CVDD TOTAL。更新了脚注.........................60
• 电源管理模块特性表：更新了表和脚注............................................................................................................60
• 样本总误差计算表：将TTEST 更改为TOPERATING_POINT 并将“测试温度”更改为“工作温度”.................... 77
• ExtR PCB 布局示例图：更新了图。................................................................................................................77
• 闪存参数表：更新了编程时间。将“每个扇区的写入/擦除周期”和“整个闪存的写入/擦除周期”替换为“每
个存储体的写入/擦除周期”；添加了相关脚注.................................................................................................80
• 连接到14 引脚JTAG 接头图：将TMS 线路和3.3V 之间连接的电阻从“4.7kΩ”更改为“2.2kΩ”........... 82
• 连接到20 引脚JTAG 接头图：将TMS 线路和3.3V 之间连接的电阻从“4.7kΩ”更改为“2.2kΩ”........... 82
• 模拟引脚和内部连接表：更新了A14/C4 的“引脚/封装”列。更新了A19/C19 和A20/C20 的“48 QFN”
列。更新了脚注.................................................................................................................................................98
• ADC 选项和配置级别表：更新了“基准电压源”选项的可配置性信息。删除了有关更低引脚数封装的脚注103
• 12 位模式下的ADC 时序表：添加了脚注以引用TMS320F280013x 实时MCU 器件勘误表中的“ADC：
DMA 读取过时结果”公告..............................................................................................................................109
• 比较器子系统(CMPSS) 模块一节：添加了CMPx_DACL 小节.....................................................................112
• CMPSS 比较器电气特性表：向“迟滞”行添加了最小值和最大值............................................................... 115
• CMPSS_LITE 比较器电气特性表：更新了“迟滞”行的最小值、典型值和最大值。更新了“响应时间”（睡
眠响应）的最大值........................................................................................................................................... 115
• CMPSS_LITE DAC 静态电气特性表：添加了“静态DNL”和“静态INL”的最小值和最大值并删除了其典型
值。在“分辨率”行添加了对新“单调响应时为9.5 位有效分辨率”脚注的引用。删除了“有效分辨率（单调
响应）”行......................................................................................................................................................115
• CMPx_DACL 缓冲输出的电气特性表：更新了“偏移”、“增益”、“DNL”和“INL”的最小值和最大值并
删除了其典型值。更新了DNL 和INL 的单位。添加/更新了脚注....................................................................115
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