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X5114J

更新时间： 2024-10-03 03:15:15
品牌 Logo 应用领域
XICOR 微控制器和处理器串行IO控制器通信控制器外围集成电路
页数 文件大小 规格书
40页 562K
描述
System Controller

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X5114J 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：PLASTIC, LCC-44Reach Compliance Code：unknown
风险等级：5.92Is Samacsys：N
地址总线宽度：8边界扫描：NO
外部数据总线宽度：JESD-30 代码：S-PQCC-J44
JESD-609代码：e0长度：16.5862 mm
低功率模式：YES串行 I/O 数：2
端子数量：44最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装等效代码：LDCC44,.7SQ
封装形状：SQUARE封装形式：CHIP CARRIER
电源：5 V认证状态：Not Qualified
座面最大高度：4.57 mm子类别：Other Microprocessor ICs
最大压摆率：5 mA最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD宽度：16.5862 mm
uPs/uCs/外围集成电路类型：SERIAL IO/COMMUNICATION CONTROLLER, SERIALBase Number Matches：1

X5114J 数据手册

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X5114  
System Controller  
FEATURES  
DESCRIPTION  
• Simplifies Backplane Communications  
• Monitor Fault and “Hot Docking” Conditions  
• Ten Level Selectable Input Threshold  
• Two Fully Redundant SPI Serial I/O Ports  
• Programmable Output or Input Port Pins  
—16 General I/O pins  
The X5114 is a single-chip system controller that is used  
in applications such as multiprocessing, telecommunica-  
tions, data communications, cable systems, set top  
boxes, etc. The chip can implement features such as  
backplane communication, hot docking, cable diagnos-  
tics, etc.  
—8 bit Port with 4 Handshake Modes  
• Single Read Input Mode  
The X5114 makes extensive use of nonvolatile memory  
with 4,096 bits of general purpose EEPROM, nonvolatile  
configuration registers, and nonvolatile programming of  
the port pins. The ports can be set up as sixteen general  
I/Os with pin selectable data direction (including eight  
inputs with nonvolatile threshold selections) or as an  
eight bit port with handshake. The chip is controlled via  
two redundant 2MHz SPI serial ports.  
• Multiple Read Input Mode  
• Output Mode  
• Bidirectional Mode  
—Port Tristate Control  
• Programmable Interrupt and Mask Options  
• 8-bit Direct Address Decoder allows Cascaded  
255+ devices on one SPI bus  
• 4K bits of EEPROM with 32 byte page write  
• Default Output Data on Port at Power-up  
• High Reliability EEPROM  
A sophisticated interrupt controller provides notification of  
a failed SPI command, changing conditions on an input,  
handshake status, and I/O errors. Interrupts are  
maskable.  
—Endurance - 105 Data Changes  
—Data Retention - 100 years  
On-chip EEPROM provides nonvolatile storage of  
system status, manufacturing information, board ID or  
other parameters.  
• 44-Pin PLCC, 48-Lead TQFP  
FUNCTIONAL DIAGRAM  
Port A Each Pin  
PA7  
CSO  
CSC  
PA6  
PA5  
PA4  
PA3  
PA2  
PA1  
PA0  
Desired  
Value  
Output  
Input  
CSa  
Port A  
Latch  
SIa  
SPI_A  
SOa  
Interrupt  
Logic  
Threshold  
Adjust  
SCKa  
Serial  
Engine/  
Data Flow  
Controller  
CSb  
SIb  
IRQA  
IRQB  
PCE  
SPI_B  
Interrupt  
Control A/B  
SOb  
SCKb  
Port  
Config  
Regs  
Handshake  
Logic  
(PB7-PB4)  
A0  
Interrupt  
Logic  
Address  
Select  
Decode  
.
.
256 X 8  
.
PB7  
PB6  
PB5  
PB4  
PB3  
PB2  
PB1  
PB0  
Desired  
Value  
.
A7  
Output  
256 X 8  
Port A  
Handshake  
Port B  
Latch  
EEPROM  
Input  
= EEPROM  
Port B Each Pin  
Xicor, Inc. 1994 - 1997 Patents Pending  
7054-1.2 10/29/00 T13/C8/D24 SH  
Characteristics subject to change without notice  
1
1234567...40

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