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WED3DG7265V75D2

更新时间： 2023-01-03 05:22:01
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WEDC 动态存储器
页数 文件大小 规格书
6页 453K
描述
Synchronous DRAM Module, 64MX72, CMOS, DIMM-168

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WED3DG7265V75D2 数据手册

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WED3DG7265V-D2  
512MB- 64Mx72 SDRAM UNBUFFERED  
FEATURES  
DESCRIPTION  
n Burst Mode Operation  
The WED3DG7265V is a 64Mx72 synchronous DRAM module  
which consists of nine 64Mx 8 SDRAM components in TSOP- 11  
package, and one 2K EEPROM in an 8- pin TSSOP package for  
Serial Presence Detect which are mounted on a 168 Pin DIMM  
multilayer FR4 Substrate.  
n Auto and Self Refresh capability  
n LVTTL compatible inputs and outputs  
n Serial Presence Detect with EEPROM  
n Fully synchronous: All signals are registered on the positive  
edge of the system clock  
n Programmable Burst Lengths: 1, 2, 4, 8 or Full Page  
n 3.3 volt 6 0.3v Power Supply  
*
This datasheet describes a product that may or may not be under development  
and is subject to change or cancellation without notice.  
n 168- Pin DIMM JEDEC  
PIN CONFIGURATIONS (FRONT SIDE/BACK SIDE)  
PIN NAMES  
Pin  
1
2
Front  
VSS  
DQ0  
DQ1  
DQ2  
DQ3  
VDD  
DQ4  
DQ5  
DQ6  
DQ7  
DQ8  
VSS  
DQ9  
DQ10  
DQ11  
DQ12  
DQ13  
VDD  
DQ14  
DQ15  
CB0  
Pin  
29  
30  
31  
32  
33  
34  
35  
36  
37  
38  
39  
40  
41  
42  
43  
44  
45  
46  
47  
48  
49  
50  
51  
52  
53  
54  
55  
56  
Front  
DQM1  
CS0  
DNU  
VSS  
A0  
Pin  
57  
58  
59  
60  
61  
62  
63  
64  
65  
66  
67  
68  
69  
70  
71  
72  
73  
74  
75  
76  
77  
78  
79  
80  
81  
82  
83  
84  
Front  
DQ18  
DQ19  
VDD  
DQ20  
NC  
*VREF  
*CKE1  
VSS  
Pin  
85  
86  
Back  
VSS  
Pin  
113  
114  
115  
116  
117  
118  
119  
120  
121  
122  
123  
124  
125  
126  
127  
128  
129  
130  
131  
132  
133  
134  
135  
136  
137  
Back  
DQM5  
*CS1  
RAS  
VSS  
A1  
Pin  
141  
142  
143  
144  
145  
146  
147  
148  
149  
150  
151  
152  
153  
154  
155  
156  
157  
158  
159  
160  
161  
162  
163  
164  
165  
Back  
DQ50  
DQ51  
VDD  
DQ52  
NC  
*VREF  
NC  
VSS  
A0  
–
A12Address  
input  
(Multi  
Input  
BA0-1  
DQ0-63  
CB0-7  
Select Bank  
Data Input/Output  
DQ32  
DQ33  
DQ34  
DQ35  
VDD  
3
4
87  
88  
Check bit (Data-in/data-out)  
CLK0,CLK2Clock  
Clock Enable input  
CS0,CS2Chip  
input  
5
6
89  
90  
CKE0  
A2  
A3  
select  
7
8
A4  
A6  
91  
92  
DQ36  
DQ37  
DQ38  
DQ39  
DQ40  
VSS  
DQ41  
DQ42  
DQ43  
DQ44  
DQ45  
VDD  
A5  
A7  
RAS  
CAS  
WE  
DQM0-7  
VDD  
VSS  
*VREF  
SDA  
Row Address Strobe  
ColumnAddress Strobe  
Write Enable  
9
A8  
A10/AP  
BA1  
DQ21  
DQ22  
DQ23  
VSS  
DQ24  
DQ25  
DQ26  
DQ27  
VDD  
93  
94  
A9  
BA0  
A11  
VDD  
*CLK1  
A12  
VSS  
CKE0  
*CS3  
DQM6  
DQM7  
*A13  
VDD  
NC  
DQ53  
DQ54  
DQ55  
VSS  
DQ56  
DQ57  
DQ58  
DQ59  
VDD  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
95  
96  
97  
DQM  
Power Supply (3.3V)  
Ground  
VDD  
VDD  
CLK0  
VSS  
DNU  
CS2  
DQM2  
DQM3  
DNU  
VDD  
NC  
98  
99  
Power supply for reference  
Serial data I/O  
100  
101  
102  
103  
104  
105  
106  
107  
108  
109  
SCL  
Serial clock  
SA0-2Address  
Do not use  
No Connect  
DQ28  
DQ29  
DQ30  
DQ31  
VSS  
DQ60  
DQ61  
DQ62  
DQ63  
VSS  
in  
EEPR  
DQ46  
DQ47  
CB4  
DNU  
NC  
CB1  
VSS  
NC  
CB5  
VSS  
NC  
NC  
CLK2  
NC  
NC  
CB6  
CB7  
*CLK3  
NC  
CB2  
CB3  
VSS  
DQ16  
DQ17  
*
These pins are not used in this module.  
NC  
VDD  
WE  
NC  
NC  
**SA0  
** These pins should be NC in the system which  
does not support SPD.  
**SDA110  
**SCL  
VDD  
VDD  
138  
VSS  
166 1 **SA  
111  
112  
CAS  
DQM4  
139  
140  
DQ48  
DQ49  
167  
168  
**SA2  
VDD  
DQM0  
White Electronic Designs Corporation • (508) 366-5151 • www.whiteedc.com  
Sept. 2002 Rev. 0  
ECO #15459  
1
123456

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