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TS88915TVW70

更新时间： 2024-09-21 15:55:07

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爱特美尔 - ATMEL		/
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19页	258K
描述
PLL Based Clock Driver, 8 True Output(s), 0 Inverted Output(s), CMOS, CQCC28, CERAMIC, LCC-28

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TS88915TVW70 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
零件包装代码：	QLCC	包装说明：	QCCJ, LDCC28,.5SQ
针数：	28	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.05
Is Samacsys：	N	输入调节：	MUX
JESD-30 代码：	S-CQCC-J28	JESD-609代码：	e0
长度：	11.43 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
最大I（ol）：	0.036 A	湿度敏感等级：	2
功能数量：	1	反相输出次数：
端子数量：	28	实输出次数：	8
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	QCCJ	封装等效代码：	LDCC28,.5SQ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
电源：	5 V	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.75 ns	座面最大高度：	2.99 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	5.25 V
最小供电电压 (Vsup)：	4.75 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	宽度：	11.43 mm
最小 fmax：	70 MHz	Base Number Matches：	1

TS88915TVW70 数据手册

Features

• Vcc = 5V ± 5%

• Military Temperature Range

• Fully Compatible with the TS68040

• Five Low Skew Outputs

– Five Outputs (Q0-Q4) with Output-to-Output Skew < 500 ps Each Being Phase End

Frequency Locked to the SYNC Input

• Three Additional Outputs are Available:

– The 2X_Q Output Runs Twice the System “Q” Frequency

– The Q/2 Output Runs At 1/2 the System “Q” Frequency

– The Q5 Output is Inverted (180° Phase Shift)

• Two Selectable Clock Inputs

– Two Selectable CLOCK Inputs are Available for Test or Redundancy Purposes

– Test Mode Pin (PLL_EN) Provided for Low Frequency Testing

– All Outputs Can Go Into High Impedance (3-state) for Board Test Purposes

• Input Frequency Range From 5 MHz to 2X_Q FMAX

• Three Input/Output Ratios

Low Skew

CMOS PLL

Clock Driver

Tri-State 70 and

100 MHz

– Input/Output Phase-locked Frequency Ratios of 1:2, 1:1 and 2:1 are Available

• Low Part-to-part Skew

– The Phase Variation from Part-to-part Between the SYNC and FEEDBACK Inputs is

Less than 550 ps (Derived From the tPD Specification, which Defines the

Part-to-part Skew)

Versions

• CMOS and TTL Compatible

– All Outputs Can Drive Either CMOS or TTL Inputs

– All Inputs are TTL-level Compatible

• LOCK Indicator (LOCK) Indicates a Phase-locked State

TS88915T

Description

The TS88915T Clock Driver utilizes a phazed-locked loop (PLL) technology to lock its

low skew outputs’ frequency and phase onto an input reference clock. It is designed to

provide clock distribution for high performance microprocessors such as TS68040,

TSPC603E,TSPC603P,TSPC603R, PCI bridge, RAM’s, MMU’s.

Screening/Quality

This Product is Manufactured:

•

Based Upon the Generic Flow of MIL-STD-883

or According to Atmel-Grenoble Standard

R suffix

PGA 29

W suffix

LDCC 28

Ceramic Pin Grid Array

Leaded Ceramic Chip Carrier

Rev. 2122A–HIREL–06/02

12 3 4 5 6 7...19

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型号	品牌	获取价格	描述	数据表
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TS8B	TTELEC	获取价格	Surface mount TSSOP resistor network, GUS-TS
TS8B-SQ	JST	获取价格	具有0.64mm方形接线柱的2.54sb头可用于将任何2.54mm插座连接到PC板。它们也
TS8C	YAMAICHI	获取价格	Modular Jacks
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