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Datasheet > 射频和微波 > 射频/微波上/下变频器> TRF1121
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TRF1121

更新时间： 2024-02-18 04:12:04
品牌 Logo 应用领域
德州仪器 - TI 射频和微波射频上变频器射频下变频器微波上变频器微波下变频器
页数 文件大小 规格书
27页 1368K
描述
Dual VCO/PLL Synthesizer With IF Up-Converter

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TRF1121 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete包装说明：LCC48,.27SQ,20
Reach Compliance Code：compliantFactory Lead Time：1 week
风险等级：5.81构造：COMPONENT
最大中频频率：350 MHz最小中频频率：250 MHz
输入功率最小值（CW）：20 dBmJESD-609代码：e3
LO 可调谐：YES安装特点：SURFACE MOUNT
端子数量：48最高工作温度：85 °C
最低工作温度：-40 °C最大输出功率：
封装主体材料：PLASTIC/EPOXY封装等效代码：LCC48,.27SQ,20
电源：5 VRF输出最大频率：2500 MHz
RF输出频率-最小值：1500 MHz射频/微波设备类型：UP CONVERTER
子类别：RF/Microwave Up/Down Converters表面贴装：YES
端子面层：Matte Tin (Sn)Base Number Matches：1

TRF1121 数据手册

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TRF1121  
TRF1221  
www.ti.com  
SLWS170A–APRIL 2005–REVISED DECEMBER 2005  
INPUT REFERENCE REQUIREMENTS  
Conditions: Signal BW = 6 MHz nom, 15 dB maximum loss IF2 SAW filter. See Figure 19  
PARAMETER  
TEST CONDITIONS  
MIN  
TYP  
MAX  
UNIT  
fRef  
Reference frequency  
18  
MHz  
PPM  
Vpp  
Temperature stability  
Customer requirements  
VFR  
DCfref  
tFR  
Ref. source input voltage(1)  
Reference Input Symmetry  
Reference source pulse rise time  
Reference Phase Noise at 10 kΩ offset  
HCMOS Output  
4
4.5  
5
60%  
4
Waveform Duty Cycle  
40%  
10% to 90% of maximum voltage transition  
1
nsec  
fFR  
–153  
–150 dBc/Hz  
(1) Note that for source peak-to-peak voltages of less than 4 V and dc-component other than 2.5-V degradation of the close-in phase noise  
may occur. For oscillators with no dc-component, a dc-voltage may be applied using a voltage divider (see the schematic) .  
AC TIMING, SERIAL BUS INTERFACE  
PARAMETER  
Clock to data invalid  
Data valid to clock  
Clock pulse width high  
Clock pulse width low  
Clock to enable low  
Enable low to clock  
Enable pulse width  
TEST CONDITIONS  
MIN  
10  
10  
50  
50  
10  
10  
10  
TYP  
MAX  
UNIT  
ns  
CDI  
See Figure 7  
See Figure 7  
See Figure 7  
See Figure 7  
See Figure 7  
See Figure 7  
See Figure 7  
DVC  
CPWH  
CPWL  
CEL  
ns  
ns  
ns  
ns  
ELC  
ns  
EPWH  
ns  
DIGITAL INTERFACE CHARACTERISTICS  
Conditions: Signal BW = 6 MHz nom, 15 dB maximum loss IF2 SAW filter. See Figure 19  
PARAMETER  
Input high voltage  
Input low voltage  
TEST CONDITIONS  
MIN TYP  
MAX  
5
UNIT  
V
VIH  
VIL  
IIH  
2.1  
0
0.8  
50  
V
Input high current  
Input low current  
0
µA  
µA  
pF  
V
IIL  
0
–50  
CI  
Input capacitance  
Output logic 1 voltage  
Output logic 1 impedance  
Output low voltage  
3
VOH  
ROH  
VOL  
0 to 100-µA load  
2.4  
18  
0
3.6  
0.4  
kΩ  
V
0 to –100-µA load  
AUXILIARY AND CONTROL  
PARAMETER  
TEST CONDITIONS  
MIN  
TYP MAX UNIT  
V VCOenb  
VLD1  
External VCO enable voltage CMOS compatible Input. See Table 9  
V
Lock detect voltage (PLL1)  
Lock Detect Voltage (PLL2)  
CMOS compatible output (active high). See Table 9  
V
VLD2  
CMOS compatible output (active high). See Table 9  
V
IF Output On  
IF Output Off  
High  
Low  
High  
Low  
Low  
High  
Low  
Low  
TXON  
IF Amp Enable  
EXTLO2IP  
EXTLO2IN  
EXTLO2IP  
EXTLO2IN  
EXTLO2IP  
EXTLO2IN  
On-chip VCO2A selection  
On-chip VCO2B selection  
On-chip VCO2 selection  
Logic level applied to EXTLOIP and EXTLOIN pins to  
select either on chip VCO 2A or 2B. Pullup resistor = 200 Ω  
and pulldown resistor = 1 kΩ.  
Logic Level applied to EXTLOIP and EXTLOIN pins to  
select the external VCO2 input  
6
1...3456789...27

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