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SSTV16857

更新时间： 2024-02-18 20:23:32
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD /
页数 文件大小 规格书
7页 87K
描述
14-Bit Register with SSTL-2 Compatible I/O and Reset

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SSTV16857 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：TSSOP, TSSOP48,.3,20
针数：48Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.16
系列：SSTVJESD-30 代码：R-PDSO-G48
JESD-609代码：e3长度：12.5 mm
逻辑集成电路类型：D FLIP-FLOP湿度敏感等级：2
位数：14功能数量：1
端子数量：48最高工作温度：70 °C
最低工作温度：输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP48,.3,20封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：2.5 V传播延迟（tpd）：2.8 ns
认证状态：Not Qualified座面最大高度：1.2 mm
子类别：Other Logic ICs最大供电电压 (Vsup)：2.7 V
最小供电电压 (Vsup)：2.3 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.5 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：6.1 mm
最小 fmax：200 MHzBase Number Matches：1

SSTV16857 数据手册

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September 2000  
Revised June 2005  
SSTV16857 • SSTVN16857  
14-Bit Register with SSTL-2 Compatible I/O and Reset  
General Description  
The SSTV16857 is a 14-bit register designed for use with  
Features  
■ Compliant with DDR-I registered module specifications  
184 and 232 pin PC1600, 2100, and 2700 DDR DIMM  
■ Operates at 2.5V 0.2V VDD  
applications. The SSTVN16857 is  
a 14-bit register  
■ SSTL-2 compatible input and output structure  
■ Differential SSTL-2 compatible clock inputs  
■ Low power mode when device is reset  
■ Industry standard 48 pin TSSOP package  
designed for use with 184 and 232 pin PC3200 DDR DIMM  
applications. These devices have a differential input clock,  
SSTL-2 compatible data inputs and a LVCMOS compatible  
RESET input. These devices have been designed for com-  
pliance with the JEDEC DDR module and register specifi-  
cations.  
The devices are fabricated on an advanced submicron  
CMOS process and are designed to operate at power sup-  
plies of less than 3.6V’s.  
Ordering Code:  
Order Number Package Number  
Package Description  
SSTV16857MTD  
MTD48  
MTD48  
48-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 6.1mm Wide  
48-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 6.1mm Wide  
SSTVN16857MTD  
(Preliminary)  
Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.  
Connection Diagram  
Pin Descriptions  
Pin Name Description  
Q1-Q14  
D1-D14  
SSTL-2 Compatible Output  
SSTL-2 Compatible Inputs  
RESET  
CK  
Asynchronous LVCMOS Reset Input  
Positive Master Clock Input  
CK  
Negative Master Clock Input  
VREF  
VDDQ  
VDD  
Voltage Reference Pin for SSTL Level Inputs  
Power Supply Voltage for Output Signals  
Power Supply Voltage for Inputs  
Truth Table  
Dn  
Qn  
RESET  
CK  
CK  
L
X or  
X or  
X or  
L
Floating  
Floating  
Floating  
H
H
H
H
L
H
X
X
L
H
L
H
L
Qn  
Qn  
H
L
H
X
Logic LOW  
Logic HIGH  
Don’t Care, but not floating unless noted  
LOW-to-HIGH Clock Transition  
HIGH-to-LOW Clock Transition  
© 2005 Fairchild Semiconductor Corporation  
DS500387  
www.fairchildsemi.com  
1234567

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与SSTV16857相关器件

型号 品牌 获取价格 描述 数据表
SSTV16857CG IDT

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 		TSSOP-48, Tube
SSTV16857CG-T IDT

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SSTV16857DGG NXP

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 		14-bit SSTL_2 registered driver with differential clock inputs
SSTV16857DGG PHILIPS

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 		Bus Driver, PDSO48
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 		IC SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO48, 6.10 MM, PLASTIC
SSTV16857DGV NXP

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 		14-bit SSTL_2 registered driver with differential clock inputs

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