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| 是否无铅： | 不含铅 | 是否Rohs认证： | 符合 |
| 生命周期： | Obsolete | 零件包装代码： | SOIC |
| 包装说明： | SOP, SOP14,.3 | 针数： | 14 |
| Reach Compliance Code： | compliant | HTS代码： | 8542.39.00.01 |
| 风险等级： | 5.47 | 系列： | LS |
| JESD-30 代码： | R-PDSO-G14 | JESD-609代码： | e4 |
| 长度： | 10.2 mm | 负载电容（CL）： | 15 pF |
| 逻辑集成电路类型： | NAND GATE | 最大I（ol）： | 0.008 A |
| 湿度敏感等级： | 1 | 功能数量： | 4 |
| 输入次数： | 2 | 端子数量： | 14 |
| 最高工作温度： | 70 °C | 最低工作温度： | |
| 封装主体材料： | PLASTIC/EPOXY | 封装代码： | SOP |
| 封装等效代码： | SOP14,.3 | 封装形状： | RECTANGULAR |
| 封装形式： | SMALL OUTLINE | 包装方法： | TAPE AND REEL |
| 峰值回流温度（摄氏度）： | 260 | 电源： | 5 V |
| 最大电源电流（ICC）： | 14 mA | Prop。Delay @ Nom-Sup： | 22 ns |
| 传播延迟（tpd）： | 22 ns | 认证状态： | Not Qualified |
| 施密特触发器： | YES | 座面最大高度： | 2 mm |
| 子类别： | Gates | 最大供电电压 (Vsup)： | 5.25 V |
| 最小供电电压 (Vsup)： | 4.75 V | 标称供电电压 (Vsup)： | 5 V |
| 表面贴装： | YES | 技术： | TTL |
| 温度等级： | COMMERCIAL | 端子面层： | Nickel/Palladium/Gold (Ni/Pd/Au) |
| 端子形式： | GULL WING | 端子节距： | 1.27 mm |
| 端子位置： | DUAL | 处于峰值回流温度下的最长时间： | NOT SPECIFIED |
| 宽度： | 5.3 mm |
| 型号 | 品牌 | 替代类型 | 描述 | 数据表 |
| SN74LS132NSRE4 | TI |
完全替代  |
QUADRUPLE 2-INPUT POSITIVE-NAND SCHMITT TRIGGERS |
|
| DM74LS132SJX | FAIRCHILD |
类似代替 |
Quad 2-input NAND Gate |
|
| DM74LS132SJ | FAIRCHILD |
类似代替 |
Quad 2-Input NAND Gate with Schmitt Trigger Input |
|
| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| SN74LS133D | MOTOROLA |
获取价格 |
13-INPUT NAND GATE |
|
| SN74LS133DR2 | MOTOROLA |
获取价格 |
LS SERIES, 13-INPUT NAND GATE, PDSO16, PLASTIC, SOIC-16 |
|
| SN74LS133N | MOTOROLA |
获取价格 |
13-INPUT NAND GATE |
|
| SN74LS133ND | MOTOROLA |
获取价格 |
NAND Gate, LS Series, 1-Func, 13-Input, TTL, PDIP16, PLASTIC, DIP-16 |
|
| SN74LS133NDS | MOTOROLA |
获取价格 |
NAND Gate, LS Series, 1-Func, 13-Input, TTL, PDIP16, PLASTIC, DIP-16 |
|
| SN74LS133NS | MOTOROLA |
获取价格 |
暂无描述 |
|
| SN74LS133W | ROCHESTER |
获取价格 |
NAND Gate |
|
| SN74LS136 | MOTOROLA |
获取价格 |
QUAD 2-INPUT EXCLUSIVE OR GATE |
|
| SN74LS136 | TI |
获取价格 |
QUADRUPLE 2-INPUT EXCLUSIVE OR GATES WITH OPEN-COLLECTOR OUTPUTS |
|
| SN74LS136D | TI |
获取价格 |
QUADRUPLE 2-INPUT EXCLUSIVE OR GATES WITH OPEN-COLLECTOR OUTPUTS |
|
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