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SCM6946TS8

更新时间： 2024-09-21 18:44:47
品牌 Logo 应用领域
恩智浦 - NXP 信息通信管理静态存储器光电二极管内存集成电路
页数 文件大小 规格书
9页 318K
描述
512KX8 STANDARD SRAM, 8ns, PDSO44, TSOP2-44

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SCM6946TS8 技术参数

生命周期：Transferred零件包装代码：TSOP2
包装说明：TSOP2,针数：44
Reach Compliance Code：unknownECCN代码：3A991.B.2.A
HTS代码：8542.32.00.41风险等级：5.28
最长访问时间：8 nsJESD-30 代码：R-PDSO-G44
长度：18.41 mm内存密度：4194304 bit
内存集成电路类型：STANDARD SRAM内存宽度：8
功能数量：1端子数量：44
字数：524288 words字数代码：512000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：512KX8
封装主体材料：PLASTIC/EPOXY封装代码：TSOP2
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE
并行/串行：PARALLEL认证状态：Not Qualified
座面最大高度：1.2 mm最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：BICMOS
温度等级：COMMERCIAL端子形式：GULL WING
端子节距：0.8 mm端子位置：DUAL
宽度：10.16 mmBase Number Matches：1

SCM6946TS8 数据手册

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Freescale Semiconductor, Inc.  
SEMICONDUCTOR TECHNICAL DATA  
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by MCM6946/D  
MCM6946  
SCM6946  
512K x 8 Bit Static Random  
Access Memory  
The MCM6946/SCM6946 is a 4,194,304–bit static random access memory or-  
ganizedas 524,288 words of 8 bits. Static design eliminates the need for external  
clocks or timing strobes.  
The MCM6946/SCM6946 is equipped with chip enable (E) and output enable  
(G) pins, allowing for greater system flexibility and eliminating bus contention  
problems. Either input, when high, will force the outputs into high impedance.  
TheMCM6946isavailableina400mil, 36–leadsurface–mountSOJpackage.  
YJ PACKAGE  
400 MIL SOJ  
CASE 893–02  
•
•
•
•
•
•
•
Single 3.3 V – 5%, + 10% Power Supply  
Fast Access Time: 8/10/12/15 ns  
Equal Address and Chip Enable Access Time  
All Inputs and Outputs are TTL Compatible  
Three–State Outputs  
TS PACKAGE  
44–LEAD  
TSOP TYPE II  
CASE 924A–02  
Power Operation: 195/185/180/175 mA Maximum, Active AC  
Available in TSOP or SOJ Packages  
PIN NAMES  
A0 – A18 . . . . . . . . . . . . . . . Address Inputs  
W . . . . . . . . . . . . . . . . . . . . . . . Write Enable  
G . . . . . . . . . . . . . . . . . . . . . Output Enable  
E . . . . . . . . . . . . . . . . . . . . . . . . Chip Enable  
DQ . . . . . . . . . . . . . . . . . Data Input/Output  
NC . . . . . . . . . . . . . . . . . . . . No Connection  
BLOCK DIAGRAM  
A
A
A
A
A
A
A
A
A
A
V
DD  
V
SS  
. . . . . . . . . . . . . + 3.3 V Power Supply  
. . . . . . . . . . . . . . . . . . . . . . . . . Ground  
ROW  
MEMORY MATRIX  
DECODER  
DQ  
COLUMN I/O  
COLUMN DECODER  
INPUT  
DATA  
CONTROL  
DQ  
A
A
A
A
A
A
A
A
A
DQ  
DQ  
E
W
G
REV 8  
1/29/99  
Motorola, Inc. 1999  
For More Information On This Product,  
Go to: www.freescale.com  
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型号 品牌 获取价格 描述 数据表
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 		512KX8 STANDARD SRAM, 10ns, PDSO36, 0.400 INCH, SOJ-36
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