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QG80332M800

更新时间： 2024-01-22 04:19:51

品牌	Logo	应用领域
英特尔 - INTEL		时钟外围集成电路
页数	文件大小	规格书
78页	1276K
描述
Microprocessor, 800MHz, CMOS, PBGA829, 37.50 X 37.50 MM, 1.27 MM PITCH, LEAD FREE, FCBGA-829

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QG80332M800 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	BGA	包装说明：	BGA, BGA829,29X29,50
针数：	829	Reach Compliance Code：	unknown
ECCN代码：	3A001.A.3	HTS代码：	8542.31.00.01
风险等级：	5.84	地址总线宽度：	64
边界扫描：	YES	最大时钟频率：	133 MHz
外部数据总线宽度：	64	格式：	FIXED POINT
集成缓存：	YES	JESD-30 代码：	S-PBGA-B829
长度：	37.5 mm	低功率模式：	YES
端子数量：	829	封装主体材料：	PLASTIC/EPOXY
封装代码：	BGA	封装等效代码：	BGA829,29X29,50
封装形状：	SQUARE	封装形式：	GRID ARRAY
电源：	1.3,1.5,1.8/2.5,3.3 V	认证状态：	Not Qualified
座面最大高度：	2.942 mm	速度：	800 MHz
子类别：	Other Microprocessor ICs	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
端子形式：	BALL	端子节距：	1.27 mm
端子位置：	BOTTOM	宽度：	37.5 mm
uPs/uCs/外围集成电路类型：	MICROPROCESSOR	Base Number Matches：	1

QG80332M800 数据手册

Intel® 80332 I/O Processor

Datasheet

Product Features

■ Integrated Intel XScale^®core

—500, 667 and 800 MHz

■ Memory Controller

—PC2700 Double Data Rate (DDR333)

SDRAM

—DDRII 400 SDRAM

—Up to 2 GB of 64-bit DDR333

—Up to 1 GB of 64-bit DDRII400

—Optional Single-bit Error Correction,

Multi-bit Detection Support (ECC)

—ARM* V5TE Compliant

—32 KByte, 32-way Set Associative

Instruction Cache with cache locking

—32 KByte, 32-way Set Associative Data

Cache with cache locking. Supports

write through or write back

—Supports Unbuffered or Registered

DIMMs and Discrete SDRAM

—32-bit memory support

—2 KByte, 2-way Set Associative

Mini-Data Cache

—128-Entry Branch Target Buffer

—8-Entry Write Buffer

■ DMA Controller

—Two Independent Channels Connected

to Internal Bus

—Two 1KB Queues in Ch0 and Ch1

—CRC-32C Calculation

—4-Entry Fill and Pend Buffer

—Performance Monitor Unit

—Internal Bus 266 MHz/64-bit

■ PCI Express-to-PCI Bridges

—x8 PCI Express Upstream Link

■ Application Accelerator Unit

—Performs optional XOR on Read Data

—PCI Express Specification 1.0a

compliant

—Compute Parity Across Local Memory

Blocks

—PCI-X Bus A (IOP bus - ATU interface)

—1 KB/512-byte Store Queue

—PCI-X Bus B (Slot Expansion bus)

■ Two UART (16550) Units

supports standard PCI Hot-Plug Controller

—64-byte Receive and Transmit FIFOs

—Four output clocks per PCI-X bus

■ Address Translation Unit

—4-pin, Master/Slave Capable

■ Peripheral Bus Interface

—8-/16-bit Data Bus with Two Chip Selects

—2 KB or 4 KB Outbound Read Queue

—4 KB Outbound Write Queue

■ Interrupt Controller Unit

—Four Priority Levels

—Vector Generation

—4 KB Inbound Read and Write Queue

—Connects Internal Bus to PCI/X Bus A

—Messaging Unit and Expansion ROM

—Sixteen External Interrupt Pins with

High Priority Interrupt (HPI#)

■ Two Programmable 32-bit Timers and

■ 829-Ball, Flip Chip Ball Grid Array (FCBGA)

Watchdog Timer

—37.5 mm²and 1.27 mm ball pitch

■ Eight General Purpose I/O Pins

■ Two I²C Bus Interface Units

Warning: Intel Corporation products are not intended for use in life support appliances,

devices or systems. Use of a Intel products in such applications without written

consent is prohibited.

Document Number: 274066-004US

August 2005

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