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PALC22V10B-15JIT PDF预览

PALC22V10B-15JIT

更新时间： 2024-09-21 15:47:31
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟输入元件可编程逻辑
页数 文件大小 规格书
3页 70K
描述
OT PLD, 15ns, CMOS, PQCC28, PLASTIC, LCC-28

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PALC22V10B-15JIT 技术参数

生命周期：Obsolete零件包装代码：QLCC
包装说明：QCCJ,针数：28
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.7其他特性：10 MACROCELLS; 1 EXTERNAL CLOCK; SHARED INPUT/CLOCK; VARIABLE PRODUCT TERMS
最大时钟频率：50 MHzJESD-30 代码：S-PQCC-J28
长度：11.5316 mm专用输入次数：11
I/O 线路数量：10端子数量：28
最高工作温度：85 °C最低工作温度：-40 °C
组织：11 DEDICATED INPUTS, 10 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装形状：SQUARE封装形式：CHIP CARRIER
可编程逻辑类型：OT PLD传播延迟：15 ns
认证状态：Not Qualified座面最大高度：4.572 mm
最大供电电压：5.5 V最小供电电压：4.5 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD宽度：11.5316 mm
Base Number Matches：1

PALC22V10B-15JIT 数据手册

 浏览型号PALC22V10B-15JIT的Datasheet PDF文件第2页浏览型号PALC22V10B-15JIT的Datasheet PDF文件第3页 
This is an abbreviated datasheet. Contact a Cypress repre-  
sentative for complete specifications. For new designs,  
se refer to the PALCE22V10  
PALC22V10B  
Reprogrammable CMOS PAL® Device  
• Enhanced test features  
Features  
—Phantom array  
• Advanced second generation PAL architecture  
• Low power  
—Top test  
—Bottom test  
— 90 mA max. standard  
—Preload  
— 100 mA max. military  
• High reliability  
• CMOS EPROM technology for reprogrammability  
• Variable product terms  
—Proven EPROM technology  
—100% programming and functional testing  
— 2 x (8 through 16) product terms  
• User-programmable macrocell  
— Output polarity control  
• Windowed DIP, windowed LCC, DIP, LCC, PLCC avail-  
able  
Functional Description  
— Individually selectable for registered or combinato-  
rial operation  
The Cypress PALC22V10B is a CMOS second-generation  
programmable logic array device. It is implemented with the  
familiar sum-of-products (AND-OR) logic structure and a new  
concept, the “Programmable Macrocell.”  
— 15 ns commercial and industrial  
10 ns tCO  
10 ns tS  
15 ns tPD  
50 MHz  
The PALC22V10B is executed in a 24-pin 300-mil molded DIP,  
a 300-mil windowed cerDIP, a 28-lead square ceramic lead-  
less chip carrier, a 28-lead square plastic leaded chip carrier,  
and provides up to 22 inputs and 10 outputs. When the win-  
dowed cerDIP is exposed to UV light, the 22V10B is erased  
and can then be reprogrammed. The programmable macrocell  
provides the capability of defining the architecture of each out-  
put individually. Each of the 10 potential outputs may be spec-  
ified as “registered” or “combinatorial.” Polarity of each output  
may also be individually  
— 15 ns and “20 ns” military  
10/15 ns tCO  
10/17 ns tS  
15/20 ns tPD  
50/31 MHz  
• Up to 22 input terms and 10 outputs  
Logic Block Diagram (PDIP/CDIP)  
V
I
I
I
I
I
I
I
I
I
I
CP/I  
1
SS  
12  
11  
10  
9
8
7
6
5
4
3
2
PROGRAMMABLE  
ANDARRAY  
(132X44)  
8
10  
12  
14  
16  
16  
14  
12  
10  
8
Reset  
Macrocell  
Macrocell  
Macrocell  
Macrocell  
Macrocell  
Macrocell  
Macrocell  
Macrocell  
Macrocell  
Macrocell  
Preset  
13  
I
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
I/O  
9
I/O  
8
I/O  
7
I/O  
6
I/O  
5
I/O  
4
I/O  
3
I/O  
2
I/O  
1
I/O  
0
V
CC  
V10B–1  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
Document #: 38-03018 Rev. **  
Revised March 6, 1997  
123

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与PALC22V10B-15JIT相关器件

型号 品牌 获取价格 描述 数据表
PALC22V10B-15KMB CYPRESS

获取价格

 		OT PLD, 15ns, PAL-Type, CMOS, CDFP24, CERPACK-24
PALC22V10B-15LMB CYPRESS

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 		OT PLD, 15ns, PAL-Type, CMOS, CQCC28, CERAMIC, LCC-28
PALC22V10B-15PC ETC

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 		UV-Erasable/OTP PLD
PALC22V10B-15QMB CYPRESS

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 		UV PLD, 15ns, PAL-Type, CMOS, CQCC28, WINDOWED, CERAMIC, LCC-28
PALC22V10B-15TMB CYPRESS

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PALC22V10B-15WC ETC

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PALC22V10B-20DMB CYPRESS

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PALC22V10B-20KMB CYPRESS

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 		OT PLD, 20ns, PAL-Type, CMOS, CDFP24, CERPACK-24

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